参数资料
| 型号： | XRT86L30IV-F |
| 厂商： | Exar Corporation |
| 文件页数： | 158/284页 |
| 文件大小： | 0K |
| 描述： | IC LIU/FRAMER TI/E1/J1 SGL 128LQ |
| 标准包装： | 72 |
| 控制器类型： | T1/E1/J1 调帧器，LIU |
| 电源电压： | 3.3V |
| 工作温度： | -40°C ~ 85°C |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 128-LQFP |
| 供应商设备封装： | 128-LQFP（14x20） |
| 包装： | 托盘 |
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XRT86L30
229
SINGLE T1/E1/J1 FRAMER/LIU COMBO
REV. 1.0.1
The table below shows configurations of the Alarm and Error Interrupt Enable bit of the Block Interrupt Enable
Register.
When these interrupt enable bits are set and one or more Bipolar Violations are present in the incoming DS1
frame, the XRT86L30 framer will declare Receive Bipolar Violation by doing the following:
Set the Receive Bipolar Violation bit of the Alarm and Error Status Register to one indicating there are one or
more Bipolar Violations. This status indicator is valid until the Framer Interrupt Status Register is read.
Reading this register clears the associated interrupt if Reset-Upon-Read is selected in Interrupt Control
Register (ICR). Otherwise, a write-to-clear operation by the microprocessor is required to reset these status
indicators.
The table below shows the Receive Bipolar Violation status bits of the Alarm and Error Status Register.
The table below shows configurations of the Alarm and Error Interrupt Enable bit of the Block Interrupt Enable
Register.
BLOCK INTERRUPT ENABLE REGISTER (BIER) (ADDRESS = 0X0B01H)
BIT
NUMBER
BIT NAME
BIT TYPE
BIT DESCRIPTION
1
Alarm and Error
Interrupt Enable
R/W
0 - Every interrupt generated by the Alarm and Error Interrupt Status Reg-
ister (AEISR) is disabled.
1 - Every interrupt generated by the Alarm and Error Interrupt Status Reg-
ister (AEISR) is enabled.
ALARM AND ERROR STATUS REGISTER (AESR) (ADDRESS = 0X0B02H)
BIT
NUMBER
BIT NAME
BIT TYPE
BIT DESCRIPTION
3
Receive Bipolar
Violation State
Change
RUR /
WC
0 - There is no change of Bipolar Violation state in the incoming DS1 pay-
load data.
1 - There is change of Bipolar Violation state in the incoming DS1 payload
data.
ALARM AND ERROR INTERRUPT ENABLE REGISTER (AEIER) (ADDRESS = 0X0B03H)
BIT
NUMBER
BIT NAME
BIT TYPE
BIT DESCRIPTION
4
Receive Loss of
Signal Interrupt
Enable
R/W
0 - The Receive Loss of Signal interrupt is disabled. Occurrence of Loss of
Signals will not generate an interrupt.
1 - The Receive Loss of Signal interrupt is enabled. Occurrence of Loss of
Signals will generate an interrupt.
BLOCK INTERRUPT ENABLE REGISTER (BIER) (ADDRESS = 0X0B01H)
BIT
NUMBER
BIT NAME
BIT TYPE
BIT DESCRIPTION
1
Alarm and Error
Interrupt Enable
R/W
0 - Every interrupt generated by the Alarm and Error Interrupt Status Reg-
ister (AEISR) is disabled.
1 - Every interrupt generated by the Alarm and Error Interrupt Status Reg-
ister (AEISR) is enabled.
相关PDF资料 |
PDF描述 |
|---|---|
| XRT86VL30IV-F | IC FRAMR/LIU T1/E1/J1 QD 128LQFP |
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相关代理商/技术参数 |
参数描述 |
|---|---|
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| XRT86SH221ES | 功能描述:网络控制器与处理器 IC VOYAGER LITE RoHS:否 制造商:Micrel 产品:Controller Area Network (CAN) 收发器数量: 数据速率: 电源电流（最大值）:595 mA 最大工作温度:+ 85 C 安装风格:SMD/SMT 封装 / 箱体:PBGA-400 封装:Tray |
| XRT86SH221IB | 功能描述:网络控制器与处理器 IC SDH-TO-PDH, VT/TU INTGR 21 CHNL 2FRAME RoHS:否 制造商:Micrel 产品:Controller Area Network (CAN) 收发器数量: 数据速率: 电源电流（最大值）:595 mA 最大工作温度:+ 85 C 安装风格:SMD/SMT 封装 / 箱体:PBGA-400 封装:Tray |
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