参数资料
| 型号： | XRT86VL30IV-F |
| 厂商： | Exar Corporation |
| 文件页数： | 3/175页 |
| 文件大小： | 0K |
| 描述： | IC FRAMR/LIU T1/E1/J1 QD 128LQFP |
| 标准包装： | 72 |
| 控制器类型： | T1/E1/J1 调帧器，LIU |
| 电源电压： | 3.3V |
| 工作温度： | -40°C ~ 85°C |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 128-LQFP |
| 供应商设备封装： | 128-LQFP（14x20） |
| 包装： | 托盘 |
| 其它名称： | 1016-1485 XRT86VL30IV-F-ND |
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XRT86VL30
95
SINGLE T1/E1/J1 FRAMER/LIU COMBO - T1 REGISTER DESCRIPTION
REV. 1.0.1
TABLE 81: PMON RECEIVE CRC-6 BIT ERROR COUNTER - MSB (RSBBECU)
HEX ADDRESS: 0X0905
BIT
FUNCTION
TYPE
DEFAULT
DESCRIPTION-OPERATION
7
RSBBEC[15]
RUR
0
Performance Monitor “Receive Synchronization Bit Error 16-Bit
Counter” - Upper Byte:
These RESET-upon-READ bits, along with that within the “PMON
Receive Synchronization Bit Error Counter Register LSB” combine
to reflect the cumulative number of instances that the Receive Syn-
chronization Bit errors has been detected by the Receive T1 Framer
block since the last read of this register.
This register contains the Most Significant byte of this 16-bit of the
Receive Synchronization Bit Error counter.
NOTE: For all 16-bit wide PMON registers, user must read the MSB
counter first before reading the LSB counter in order to read
the accurate PMON counts. To clear PMON count, user
must read the MSB counter first before reading the LSB
counter in order to clear the PMON count.
6
RSBBEC[14]
RUR
0
5
RSBBEC[13]
RUR
0
4
RSBBEC[12]
RUR
0
3
RSBBEC[11]
RUR
0
2
RSBBEC[10]
RUR
0
1
RSBBEC[9]
RUR
0
RSBBEC[8]
RUR
0
TABLE 82: PMON RECEIVE CRC-6 BIT ERROR COUNTER - LSB (RSBBECL)
HEX ADDRESS: 0X0906
BIT
FUNCTION
TYPE
DEFAULT
DESCRIPTION-OPERATION
7
RSBBEC[7]
RUR
0
Performance Monitor “Receive Synchronization Bit Error 16-Bit
Counter” - Lower Byte:
These RESET-upon-READ bits, along with that within the “PMON
Receive Synchronization Bit Error Counter Register MSB” combine
to reflect the cumulative number of instances that the Receive Syn-
chronization Bit errors has been detected by the Receive T1 Framer
block since the last read of this register.
This register contains the Least Significant byte of this 16-bit of the
Receive Synchronization Bit Error counter.
NOTE: For all 16-bit wide PMON registers, user must read the MSB
counter first before reading the LSB counter in order to read
the accurate PMON counts. To clear PMON count, user
must read the MSB counter first before reading the LSB
counter in order to clear the PMON count.
6
RSBBEC[6]
RUR
0
5
RSBBEC[5]
RUR
0
4
RSBBEC[4]
RUR
0
3
RSBBEC[3]
RUR
0
2
RSBBEC[2]
RUR
0
1
RSBBEC[1]
RUR
0
RSBBEC[0]
RUR
0
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