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参数资料
| 型号： | ZPSD402A2-C-15L |
| 元件分类： | 微控制器/微处理器 |
| 英文描述： | 32K X 16 UVPROM, 40 I/O, PIA-GENERAL PURPOSE, CQCC68 |
| 封装： | CERAMIC, LDCC-68 |
| 文件页数： | 122/128页 |
| 文件大小： | 433K |
| 代理商： | ZPSD402A2-C-15L |
第1页第2页第3页第4页第5页第6页第7页第8页第9页第10页第11页第12页第13页第14页第15页第16页第17页第18页第19页第20页第21页第22页第23页第24页第25页第26页第27页第28页第29页第30页第31页第32页第33页第34页第35页第36页第37页第38页第39页第40页第41页第42页第43页第44页第45页第46页第47页第48页第49页第50页第51页第52页第53页第54页第55页第56页第57页第58页第59页第60页第61页第62页第63页第64页第65页第66页第67页第68页第69页第70页第71页第72页第73页第74页第75页第76页第77页第78页第79页第80页第81页第82页第83页第84页第85页第86页第87页第88页第89页第90页第91页第92页第93页第94页第95页第96页第97页第98页第99页第100页第101页第102页第103页第104页第105页第106页第107页第108页第109页第110页第111页第112页第113页第114页第115页第116页第117页第118页第119页第120页第121页当前第122页第123页第124页第125页第126页第127页第128页
PSD4XX Family
89
-20
-25
ZPLD_TURBO
Symbol
Parameter
Conditions
Min
Max Min
Max
OFF
*
Unit
I/O Input or Feedback to
tPD
Combinatorial Output
Port B, E
55
80
Add 20
ns
tRPD
Registered Input to
(Note 1)
55
85
Add 20
ns
Combinatorial Output
tEA
Input to Output Enable
Any Input
50
80
Add 20
ns
tER
Input to Output Disable
Any Input
50
80
Add 20
ns
tARP
Register Clear or Preset Delay
Any Input
55
80
Add 20
ns
tARPW
Register Clear or Preset
Any Input
30
60
ns
Pulse Width
tARD
Array Delay
33
35
ns
Combinatorial Delays (3.0 V ± 10%)
13.10 AC/DC Parameters – ZPLD Timing Parameters (ZPSD4XXV Versions)
(3.0 V ± 10%)
NOTE: 1. Port A and latched address from ADIO (A0, A1, A8 – A15).
-20
-25
ZPLD_TURBO
Symbol
Parameter
Conditions
Min
Max
Min
Max
OFF
*
Unit
Maximum Frequency
External Feedback
1/(tS + tCO)
28.57
11.11
MHz
Maximum Frequency
fMAX
Internal Feedback (fCNT)
1/(tS+tCO–10)
17.24
12.50
MHz
Maximum Frequency
Pipelined Data
1/(tCH + tCL)
31.25
18.52
MHz
t S
Input Setup Time
Any Input
45
60
Add 20
ns
t H
Input Hold Time
Any Input
0
ns
t CH
Clock High Time
Clock Input
16
27
0
ns
t CL
Clock Low Time
Clock Input
16
27
0
ns
t CO
Clock to Output Delay
Clock Input
30
33
0
ns
tARD
Array Delay for Product
Term Expansion
Any Macrocell
24
35
0
ns
tMIN
Minimum Clock Period
t CH + t CL
30
0
ns
Synchronous Clock Mode (3.0 V ± 10%)
*NOTE: If ZPLD_TURBO is off and the ZPLD is operating above 15 MHz, there is no need to add 20 ns to the timing parameters.
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