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参数资料
| 型号： | ZPSD403A1V-C-20UI |
| 元件分类： | 微控制器/微处理器 |
| 英文描述： | 64K X 16 OTPROM, 40 I/O, PIA-GENERAL PURPOSE, PQFP80 |
| 封装： | PLASTIC, TQFP-80 |
| 文件页数： | 121/128页 |
| 文件大小： | 433K |
| 代理商： | ZPSD403A1V-C-20UI |
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PSD4XX Family
88
Symbol
Parameter
Conditions
Min
Typ
Max
Unit
VCC
Supply Voltage
All Speeds
2.7
3
5.5
V
VIH
High Level Input Voltage
2.7 V < VCC < 5.5 V
.7 VCC
VCC +.5
V
VIL
Low Level Input Voltage
2.7 V < VCC < 5.5 V
–0.5
.3 VCC
V
VIH1
Reset High Level Input Voltage
(Note 1)
.8 VCC
VCC +.5
V
VIL1
Reset Low Level Input Voltage
(Note 1)
–.5
.2 VCC –.1
V
VHYS
Reset Pin Hysteresis
0.3
V
VOL
Output Low Voltage
IOL = 20 A, VCC = 2.7 V
0.01
0.1
V
IOL = 4 mA, VCC = 2.7 V
0.15
0.45
V
VOH
Output High Voltage
IOH = –20 A, VCC = 2.7 V
2.9
2.99
V
IOH = –1 mA, VCC = 2.7 V
2.4
2.6
V
VSBY
SRAM Standby Voltage
2.7
VCC
V
ISBY
SRAM Standby Current
VCC = 0 V
0.5
1
A
IIDLE
Idle Current (VSTBY Pin)
VCC > VSBY
–0.1
0.1
A
VDF
SRAM Data Retention Voltage
Only on VSTBY
2V
ISB
Standby Supply
Power Down Mode
CSI >VCC –.3 V (Note 2)
5
15
A
Current
Sleep Mode
CSI >VCC –.3 V (Note 3)
1
5
A
ILI
Input Leakage Current
VSS < VIN < VCC
–1
±.1
1
A
ILO
Output Leakage Current
0.45 < VIN < VCC
–10
± 5
10
A
ZPLD_TURBO = OFF,
See ISB
A
ICC (DC)
Operating
f = 0 MHz (Note 4)
(Note 5)
Supply Current
ZPLD Only
ZPLD_TURBO = ON,
f = 0 MHz
200
400
A/PT
ZPLD AC Base
(Note 4)
See
2.0
mA/MHz
Fig 38c
CMiser = ON
EPROM AC Adder
(8-Bit Bus Mode)
0.4
1.0
mA/MHz
ICC (AC)
All Other Cases
0.9
1.7
mA/MHz
(Note 5)
CMiser = ON and
0.7
1.3
mA/MHz
8-Bit Bus Mode
SRAM AC Adder
CMiser = ON and
1
2
mA/MHz
16-Bit Bus MoDe
CMiser = OFF
1.9
3.8
mA/MHz
13.9 DC Characteristics (ZPSD4XXV Versions)
(3.0 V ± 10% Versions)
NOTES: 1.
Reset input has hysteresis. VIL1 is valid at or below .2VCC –.1. VIH1 is valid at or above .8VCC.
2.
CSI deselected or internal PD is active.
3.
Sleep mode bit is set and internal PD is active.
4.
See ZPLD ICC/Frequency Power Consumption graph for details.
5.
IOUT = 0 mA.
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