5M2210ZF324I5N (Altera) PDF资料下载 Datasheet(23/30 页)

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参数资料

型号：	5M2210ZF324I5N
厂商：	Altera
文件页数：	23/30页
文件大小：	0K
描述：	IC MAX V CPLD 2210 LE 324-FBGA
产品培训模块：	Max V Overview
特色产品：	MAX? V CPLDs
标准包装：	84
系列：	MAX® V
可编程类型：	系统内可编程
最大延迟时间 tpd(1)：	7.0ns
电压电源 - 内部：	1.71 V ~ 1.89 V
逻辑元件/逻辑块数目：	2210
宏单元数：	1700
输入/输出数：	271
工作温度：	-40°C ~ 100°C
安装类型：	表面贴装
封装/外壳：	324-LBGA
供应商设备封装：	324-FBGA（19x19）
包装：	托盘

Chapter 3: DC and Switching Characteristics for MAX V Devices

3–23

Timing Model and Specifications

External Timing I/O Delay Adders

The I/O delay timing parameters for the I/O standard input and output adders and

the input delays are specified by speed grade, independent of device density.

Table 3–32 through Table 3–36 on page 3–25 list the adder delays associated with I/O

pins for all packages. If you select an I/O standard other than 3.3-V LVTTL, add the

input delay adder to the external t SU timing parameters listed in Table 3–26 on

page 3–20 through Table 3–31 . If you select an I/O standard other than 3.3-V LVTTL

with 16 mA drive strength and fast slew rate, add the output delay adder to the

external t CO and t PD listed in Table 3–26 on page 3–20 through Table 3–31 .

Table 3–32. External Timing Input Delay Adders for MAX V Devices

5M40Z/ 5M80Z/ 5M160Z/

5M240Z/ 5M570Z

5M1270Z/ 5M2210Z

I/O Standard

C4

C5, I5

C4

C5, I5

Unit

Min

Max

Min

Max

Min

Max

Min

Max

3.3-V LVTTL

3.3-V LVCMOS

2.5-V LVTTL /

LVCMOS

1.8-V LVTTL /

LVCMOS

1.5-V LVCMOS

1.2-V LVCMOS

3.3-V PCI

Without Schmitt

Trigger

With Schmitt

Trigger

Without Schmitt

Trigger

With Schmitt

Trigger

Without Schmitt

Trigger

With Schmitt

Trigger

Without Schmitt

Trigger

Without Schmitt

Trigger

Without Schmitt

Trigger

Without Schmitt

Trigger

—

—

—

—

—

—

—

—

—

—

0

387

0

387

42

429

378

681

1,055

0

—

—

—

—

—

—

—

—

—

—

0

442

0

442

42

483

368

658

1,010

0

—

—

—

—

—

—

—

—

—

—

0

480

0

480

246

787

695

1,334

2,324

0

—

—

—

—

—

—

—

—

—

—

0

591

0

591

303

968

855

1,642

2,860

0

ps

ps

ps

ps

ps

ps

ps

ps

ps

ps

Table 3–33. External Timing Input Delay t GLOB Adders for GCLK Pins for MAX V Devices (Part 1 of 2)

5M40Z/ 5M80Z/ 5M160Z/

5M240Z/ 5M570Z

5M1270Z/ 5M2210Z

I/O Standard

C4

C5, I5

C4

C5, I5

Unit

Min

Max

Min

Max

Min

Max

Min

Max

3.3-V LVTTL

Without Schmitt

Trigger

With Schmitt

Trigger

—

—

0

387

—

—

0

442

—

—

0

400

—

—

0

493

ps

ps

May 2011

Altera Corporation

MAX V Device Handbook

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EBA18DRMS	CONN EDGECARD 36POS .125 SQ WW
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