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参数资料
| 型号： | 73S1215F-EB |
| 厂商： | Maxim Integrated Products |
| 文件页数： | 111/136页 |
| 文件大小： | 0K |
| 描述： | BOARD EVAL 73S1215F CBL/DOC/CD |
| 产品培训模块： | Lead (SnPb) Finish for COTS Obsolescence Mitigation Program |
| 标准包装： | 1 |
| 系列： | * |
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73S1215F Data Sheet
DS_1215F_003
1.7.15 Smart Card Interface Function
The 73S1215F integrates one ISO-7816 (T=0, T=1) UART, one complete ICC electrical interface as well
as an external smart card interface to allow multiple smart cards to be connected using the Teridian 8010
family of interface devices. Figure 15 shows the simplified block diagram of the card circuitry (UART +
interfaces), with detail of dedicated XRAM registers.
iple smart cards to be connected using the Teridian 8010
family of interface devices. Figure 15 shows the simplified block diagram of the card circuitry (UART +
interfaces), with detail of dedicated XRAM registers.
Direct
Mode
Card
Insertion
Activation /
Deactivation
Sequencer
VCC
Buffer / Level
Shifter
RST
Buffer / Level
Shifter
CLK
I/O
Buffer / Level
Shifter
C4
Buffer / Level
Shifter
C8
Buffer / Level
Shifter
VCC Card
Generation
ICC Event
ICC Pwr_event
I/O ICC#1
I/
O
E
xt
.
IC
C
CLK ICC
CLKExt. ICC
Card Clock
Management
7.2MHz
SCCLK/
SCSCLK
PRES
Serial
UART
Internal ICC Interface
SCSel
UART
T=0 T=1
RLength
STSTO
ATRMsB/LsB
BGT/EGT
SRXData
SRXCtl
STXData
STXCtl
SCPrtcol
SCCtl
FDReg
SByteCtl
SParCtl
Card Interrupt
Management
SCInt
SCIE
External ICC Interface
Bypa
ss
Mode
XRAM Registers
VccCtl/
VccTMR
SCCLK/SCSCLK
Timers
2-Byte
Tx FIFO
2-Byte
Rx FIFO
Card and
Mode
Selection
TX
RX
SCDir
SCECtl
BGT0/1/2/3/
CWT0/1
SIO
SCLK
SCCLK
SCSCLK
Figure 15: Smart Card Interface Block Diagram
Card interrupts are managed through two dedicated registers SCIE (Interrupt Enable to define which
interrupt is enabled) and SCInt (Interrupt status). They allow the firmware to determine the source of an
interrupt, that can be a card insertion / removal, card power fault, or a transmission (TX) or reception (RX)
event / fault. It should be noted that even when card clock is disabled, an ICC interrupt can be generated
Card interrupts are managed through two dedicated registers SCIE (Interrupt Enable to define which
interrupt is enabled) and SCInt (Interrupt status). They allow the firmware to determine the source of an
interrupt, that can be a card insertion / removal, card power fault, or a transmission (TX) or reception (RX)
event / fault. It should be noted that even when card clock is disabled, an ICC interrupt can be generated
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Rev. 1.4
相关PDF资料 |
PDF描述 |
|---|---|
| ECC22DCST | CONN EDGECARD 44POS DIP .100 SLD |
| 73S1210F-EB | BOARD EVAL 73S1210F DOC/CD CABLE |
| ECC22DCMT | CONN EDGECARD 44POS .100 WW |
| 73S1209F-EB | BOARD EVAL 73S1209F DOC/CD CABLE |
| EBC25DTAS | CONN EDGECARD 50POS R/A .100 SLD |
相关代理商/技术参数 |
参数描述 |
|---|---|
| 73S1215F-EB-Lite | 功能描述:开发板和工具包 - 8051 73S1215F Eval Brd Lite (USD Cbl, D.Cd) RoHS:否 制造商:Silicon Labs 产品:Development Kits 工具用于评估:C8051F960, Si7005 核心: 接口类型:USB 工作电源电压: |
| 73S1217F | 制造商:TERIDIAN 制造商全称:TERIDIAN 功能描述:Bus-Powered 80515 System-on-Chip with USB, ISO 7816 / EMV, PINpad and More |
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