参数资料
| 型号： | A54SX08A-FGG144I |
| 厂商： | Microsemi SoC |
| 文件页数： | 57/108页 |
| 文件大小： | 0K |
| 描述： | IC FPGA SX 12K GATES 144-FBGA |
| 标准包装： | 160 |
| 系列： | SX-A |
| LAB/CLB数： | 768 |
| 输入/输出数： | 111 |
| 门数： | 12000 |
| 电源电压： | 2.25 V ~ 5.25 V |
| 安装类型： | 表面贴装 |
| 工作温度： | -40°C ~ 85°C |
| 封装/外壳： | 144-LBGA |
| 供应商设备封装： | 144-FPBGA（13x13） |
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SX-A Family FPGAs
2- 32
v5.3
Table 2-26 A54SX16A Timing Characteristics
(Worst-Case Commercial Conditions VCCA = 2.25 V, VCCI = 3.0 V, TJ = 70°C)
Parameter
Description
–3 Speed1
–2 Speed
–1 Speed
Std. Speed
–F Speed
Units
Min. Max. Min. Max. Min. Max. Min. Max. Min. Max.
3.3 V PCI Output Module Timing2
tDLH
Data-to-Pad Low to High
2.0
2.3
2.6
3.1
4.3
ns
tDHL
Data-to-Pad High to Low
2.2
2.5
2.8
3.3
4.6
ns
tENZL
Enable-to-Pad, Z to L
1.4
1.7
1.9
2.2
3.1
ns
tENZH
Enable-to-Pad, Z to H
2.0
2.3
2.6
3.1
4.3
ns
tENLZ
Enable-to-Pad, L to Z
2.5
2.8
3.2
3.8
5.3
ns
tENHZ
Enable-to-Pad, H to Z
2.2
2.5
2.8
3.3
4.6
ns
dTLH
3
Delta Low to High
0.025
0.03
0.04
0.045
ns/pF
dTHL
3
Delta High to Low
0.015
0.025
ns/pF
3.3 V LVTTL Output Module Timing4
tDLH
Data-to-Pad Low to High
2.8
3.2
3.6
4.3
6.0
ns
tDHL
Data-to-Pad High to Low
2.7
3.1
3.5
4.1
5.7
ns
tDHLS
Data-to-Pad High to Low—low slew
9.5
10.9
12.4
14.6
20.4
ns
tENZL
Enable-to-Pad, Z to L
2.2
2.6
2.9
3.4
4.8
ns
tENZLS
Enable-to-Pad, Z to L—low slew
15.8
18.9
21.3
25.4
34.9
ns
tENZH
Enable-to-Pad, Z to H
2.8
3.2
3.6
4.3
6.0
ns
tENLZ
Enable-to-Pad, L to Z
2.9
3.3
3.7
4.4
6.2
ns
tENHZ
Enable-to-Pad, H to Z
2.7
3.1
3.5
4.1
5.7
ns
dTLH
3
Delta Low to High
0.025
0.03
0.04
0.045
ns/pF
dTHL
3
Delta High to Low
0.015
0.025
ns/pF
dTHLS
3
Delta High to Low—low slew
0.053
0.067
0.073
0.107
ns/pF
Notes:
1. All –3 speed grades have been discontinued.
2. Delays based on 10 pF loading and 25
Ω resistance.
3. To obtain the slew rate, substitute the appropriate Delta value, load capacitance, and the VCCI value into the following equation:
Slew Rate [V/ns] = (0.1*VCCI – 0.9*VCCI)/ (Cload * dT[LH|HL|HLS])
where Cload is the load capacitance driven by the I/O in pF
dT[LH|HL|HLS] is the worst case delta value from the datasheet in ns/pF.
4. Delays based on 35 pF loading.
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PDF描述 |
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相关代理商/技术参数 |
参数描述 |
|---|---|
| A54SX08AFGG208A | 制造商:ACTEL 制造商全称:Actel Corporation 功能描述:SX-A Family FPGAs |
| A54SX08A-FGG208A | 制造商:ACTEL 制造商全称:Actel Corporation 功能描述:SX-A Automotive Family FPGAs |
| A54SX08AFGG208I | 制造商:ACTEL 制造商全称:Actel Corporation 功能描述:SX-A Family FPGAs |
| A54SX08A-FPQ208 | 功能描述:IC FPGA SX 12K GATES 208-PQFP RoHS:否 类别:集成电路 (IC) >> 嵌入式 - FPGA（现场可编程门阵列） 系列:SX-A 标准包装:152 系列:IGLOO PLUS LAB/CLB数:- 逻辑元件/单元数:792 RAM 位总计:- 输入/输出数:120 门数:30000 电源电压:1.14 V ~ 1.575 V 安装类型:表面贴装 工作温度:-40°C ~ 85°C 封装/外壳:289-TFBGA，CSBGA 供应商设备封装:289-CSP（14x14） |
| A54SX08A-FPQ208A | 制造商:未知厂家 制造商全称:未知厂家 功能描述:SX-A Family FPGAs |
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