参数资料
| 型号： | A54SX16-CQ208B |
| 厂商： | Microsemi SoC |
| 文件页数： | 62/64页 |
| 文件大小： | 0K |
| 描述： | IC FPGA SX 24K GATES 208-CQFP |
| 标准包装： | 1 |
| 系列： | SX |
| LAB/CLB数： | 1452 |
| 输入/输出数： | 175 |
| 门数： | 24000 |
| 电源电压： | 3 V ~ 3.6 V，4.75 V ~ 5.25 V |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 208-BFCQFP，带拉杆 |
| 供应商设备封装： | 208-CQFP（75x75） |
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SX Family FPGAs
v3.2
1-3
Chip Architecture
The SX family chip architecture provides a unique
approach to module organization and chip routing that
delivers the best register/logic mix for a wide variety of
new and emerging applications.
Module Organization
Actel has arranged all C-cell and R-cell logic modules into
horizontal banks called clusters. There are two types of
clusters: Type 1 contains two C-cells and one R-cell, while
Type 2 contains one C-cell and two R-cells.
To increase design efficiency and device performance,
Actel
has
further
organized
these
modules
into
SuperClusters (Figure 1-4). SuperCluster 1 is a two-wide
grouping of Type 1 clusters. SuperCluster 2 is a two-wide
group containing one Type 1 cluster and one Type 2
cluster. SX devices feature more SuperCluster 1 modules
than SuperCluster 2 modules because designers typically
require significantly more combinatorial logic than flip-
flops.
Figure 1-3
C-Cell
Figure 1-4
Cluster Organization
D0
D1
D2
D3
DB
A0
B0
A1
B1
Sa
Sb
Y
Type 1 SuperCluster
Type 2 SuperCluster
Cluster 1
Cluster 2
Cluster 1
R-Cell
C-Cell
D0
D1
D2
D3
DB
A0
B0
A1
B1
Sa
Sb
Y
Direct
Connect
Input
CLKA, CLKB,
Internal Logic
HCLK
CKS
CKP
CLRB
PSETB
Y
DQ
Routed Data Input
S0
S1
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PDF描述 |
|---|---|
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参数描述 |
|---|---|
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| A54SX16-CQ256B | 功能描述:IC FPGA SX 24K GATES 256-CQFP RoHS:否 类别:集成电路 (IC) >> 嵌入式 - FPGA（现场可编程门阵列） 系列:SX 标准包装:1 系列:ProASICPLUS LAB/CLB数:- 逻辑元件/单元数:- RAM 位总计:129024 输入/输出数:248 门数:600000 电源电压:2.3 V ~ 2.7 V 安装类型:表面贴装 工作温度:- 封装/外壳:352-BFCQFP，带拉杆 供应商设备封装:352-CQFP（75x75） |
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