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参数资料
| 型号： | A80960HT60 |
| 厂商： | INTEL CORP |
| 元件分类： | 微控制器/微处理器 |
| 英文描述： | 80960HA/HD/HT 32-Bit High-Performance Superscalar Processor |
| 中文描述： | 32-BIT, 60 MHz, RISC PROCESSOR, CPGA168 |
| 封装： | CERAMIC, PGA-168 |
| 文件页数： | 45/78页 |
| 文件大小： | 835K |
| 代理商： | A80960HT60 |
第1页第2页第3页第4页第5页第6页第7页第8页第9页第10页第11页第12页第13页第14页第15页第16页第17页第18页第19页第20页第21页第22页第23页第24页第25页第26页第27页第28页第29页第30页第31页第32页第33页第34页第35页第36页第37页第38页第39页第40页第41页第42页第43页第44页当前第45页第46页第47页第48页第49页第50页第51页第52页第53页第54页第55页第56页第57页第58页第59页第60页第61页第62页第63页第64页第65页第66页第67页第68页第69页第70页第71页第72页第73页第74页第75页第76页第77页第78页
Advance Information Datasheet
45
80960JA/JF/JD/JT 3.3 V Microprocessor
SYNCHRONOUS INPUT TIMINGS
T
IS1
Input Setup to CLKIN — AD31:0, NMI,
XINT7:0
80960JT
80960JD
80960JA/JF
Input Hold from CLKIN — AD31:0, NMI,
XINT7:0
80960JT
80960JD
80960JA/JF
Input Setup to CLKIN — RDYRCV and
HOLD
80960JT
80960JD
80960JA/JF
Input Hold from CLKIN — RDYRCV and
HOLD
Input Setup to CLKIN — RESET
80960JT
80960JD
80960JA/JF
Input Hold from CLKIN — RESET
80960JT
80960JD
80960JA/JF
Input Setup to RESET — ONCE, STEST
80960JT
80960JD
80960JA/JF
Input Hold from RESET — ONCE, STEST
80960JT
80960JD
80960JA/JF
6
6
9
ns
(5)
T
IH1
1.5
1.5
1.0
ns
(5)
T
IS2
6.5
6.5
10.0
ns
(6)
T
IH2
1
ns
(6)
T
IS3
7
7
8
ns
(7)
T
IH3
2
2
1
ns
(7)
T
IS4
7
7
8
ns
(8)
T
IH4
2
2
1
ns
(8)
RELATIVE OUTPUT TIMINGS
T
LX
Address Valid to ALE/ALE Inactive
For 3.3 V Data Input Signals
For 5.0 V Data Input Signals
ALE/ALE Width
Address Hold from ALE/ALE Inactive
DT/R Valid to DEN Active
0.5T
C
- 5
0.5T
C
- 8
ns
(9)
T
LXL
T
LXA
T
DXD
0.5T
C
- 7
ns
Equal Loading (9)
BOUNDARY SCAN TEST SIGNAL TIMINGS
T
BSF
TCK Frequency
0.5T
F
MHz
T
BSCH
TCK High Time
15
ns
Measured at 1.5 V
(1)
Measured at 1.5 V
(1)
0.8 V to 2.0 V (1)
2.0 V to 0.8 V (1)
T
BSCL
TCK Low Time
15
ns
T
BSCR
T
BSCF
NOTE:
See Table 24 on page 47 for note definitions for this table.
TCK Rise Time
TCK Fall Time
5
5
ns
ns
Table 23.
80960Jx AC Characteristics (Sheet 2 of 3)
Symbol
Parameter
Min
Max
Unit
Notes
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PDF描述 |
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