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参数资料
| 型号： | AD73460BB-40 |
| 厂商： | ANALOG DEVICES INC |
| 元件分类： | 数字信号处理 |
| 英文描述： | Six-Input Channel Analog Front End |
| 中文描述： | 24-BIT, 26 MHz, OTHER DSP, PBGA119 |
| 封装： | PLASTIC, CHIP SCALE, BGA-119 |
| 文件页数： | 2/32页 |
| 文件大小： | 290K |
| 代理商： | AD73460BB-40 |
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REV. 0
AD73460
–2–
Topic
Page
FEATURES . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 1
FUNCTIONAL BLOCK DIAGRAM . . . . . . . . . . . . . . . . . 1
GENERAL DESCRIPTION . . . . . . . . . . . . . . . . . . . . . . . . . 1
SPECIFICATIONS . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 3
TIMING CHARACTERISTICS . . . . . . . . . . . . . . . . . . . . . 5
ABSOLUTE MAXIMUM RATINGS . . . . . . . . . . . . . . . . . 6
ORDERING GUIDE . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 6
PBGA BALL CONFIGURATION . . . . . . . . . . . . . . . . . . . . 7
PIN FUNCTION DESCRIPTIONS . . . . . . . . . . . . . . . . . . 8
ARCHITECTURE OVERVIEW . . . . . . . . . . . . . . . . . . . . 10
ANALOG FRONT END . . . . . . . . . . . . . . . . . . . . . . . . . . 10
FUNCTIONAL DESCRIPTION
–
AFE . . . . . . . . . . . . . . . 11
Encoder Channel . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 11
Signal Conditioner . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 11
Programmable Gain Amplifier . . . . . . . . . . . . . . . . . . . . . 11
ADC . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 11
Analog Sigma-Delta Modulator . . . . . . . . . . . . . . . . . . . . 12
Decimation Filter . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 12
ADC Coding . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 13
Voltage Reference . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 13
AFE Serial Port (SPORT2) . . . . . . . . . . . . . . . . . . . . . . . 13
SPORT2 Overview . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 13
SPORT Register Maps . . . . . . . . . . . . . . . . . . . . . . . . . . . 14
Master Clock Divider . . . . . . . . . . . . . . . . . . . . . . . . . . . . 14
Serial Clock Rate Divider . . . . . . . . . . . . . . . . . . . . . . . . . 14
Decimation Rate Divider . . . . . . . . . . . . . . . . . . . . . . . . . 14
Control Registers . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 15
OPERATION . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 18
Resetting the AFE . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 18
Power Management . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 18
Operating Modes . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 18
Channel Selection . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 19
INTERFACING . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 19
Cascade Operation . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 19
FUNCTIONAL DESCRIPTION
—
DSP . . . . . . . . . . . . . . 20
Serial Ports . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 21
DSP SECTION PIN DESCRIPTIONS . . . . . . . . . . . . . . . 21
Memory Interface Pins . . . . . . . . . . . . . . . . . . . . . . . . . . . 21
Terminating Unused Pins . . . . . . . . . . . . . . . . . . . . . . . . 22
Interrupts . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 23
Topic
Page
LOW POWER OPERATION . . . . . . . . . . . . . . . . . . . . . . . 23
Power-Down . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 23
Idle . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 23
Slow Idle . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 23
SYSTEM INTERFACE . . . . . . . . . . . . . . . . . . . . . . . . . . . 24
Clock Signals . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 24
RESET
. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 25
MODES OF OPERATION . . . . . . . . . . . . . . . . . . . . . . . . 25
Setting Memory Mode . . . . . . . . . . . . . . . . . . . . . . . . . . . 25
Passive Configuration . . . . . . . . . . . . . . . . . . . . . . . . . . . . 25
Active Configuration . . . . . . . . . . . . . . . . . . . . . . . . . . . . 25
MEMORY ARCHITECTURE . . . . . . . . . . . . . . . . . . . . . . 25
PROGRAM MEMORY . . . . . . . . . . . . . . . . . . . . . . . . . . . 25
Program Memory (Full Memory Mode) . . . . . . . . . . . . . 26
Program Memory (Host Mode) . . . . . . . . . . . . . . . . . . . . 26
DATA MEMORY . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 26
Data Memory (Full Memory Mode) . . . . . . . . . . . . . . . . 26
I/O Space (Full Memory Mode) . . . . . . . . . . . . . . . . . . . . 26
Composite Memory Select (
CMS
) . . . . . . . . . . . . . . . . . . 26
Boot Memory Select (
BMS
) Disable . . . . . . . . . . . . . . . . 27
Byte Memory . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 27
Byte Memory DMA (BDMA, Full Memory Mode) . . . . . 27
Internal Memory DMA Port (IDMA Port;
Host Memory Mode) . . . . . . . . . . . . . . . . . . . . . . . . . . 27
Bootstrap Loading (Booting) . . . . . . . . . . . . . . . . . . . . . . 28
IDMA Port Booting . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 28
Bus Request and Bus Grant (Full Memory Mode) . . . . . . 28
Flag I/O Pins . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 29
INSTRUCTION SET DESCRIPTION . . . . . . . . . . . . . . . 29
DESIGNING AN EZ-ICE-COMPATIBLE
SYSTEM . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 29
Target Board Connector for EZ-ICE Probe . . . . . . . . . . . 30
Target Memory Interface . . . . . . . . . . . . . . . . . . . . . . . . . 30
PM, DM, BM, IOM, and CM . . . . . . . . . . . . . . . . . . . . . 30
Target System Interface Signals . . . . . . . . . . . . . . . . . . . . 30
ANALOG FRONT END (AFE) INTERFACING . . . . . . . 30
DSP SPORT TO AFE INTERFACING . . . . . . . . . . . . . . 30
CASCADE OPERATION . . . . . . . . . . . . . . . . . . . . . . . . . 31
Interfacing to the AFE
’
s Analog Inputs . . . . . . . . . . . . . . 31
Digital Interface . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 32
OUTLINE DIMENSIONS . . . . . . . . . . . . . . . . . . . . . . . . . 32
TABLE OF CONTENTS
相关PDF资料 |
PDF描述 |
|---|---|
| AD7346B | 2 Pair/1 Pair ETSI Compatible HDSL Analog Front End |
| AD5011 | M5100-033-0008 |
| AD5011B | 2 Pair/1 Pair ETSI Compatible HDSL Analog Front End |
| AD73522 | Dual Analog Front End with Flash based DSP Microcomputer(带闪速DSP微计算机的双模拟前端) |
| AD736JN | Low Cost, Low Power, True RMS-to-DC Converter |
相关代理商/技术参数 |
参数描述 |
|---|---|
| AD73460BB-80 | 制造商:Analog Devices 功能描述:AFE General Purpose 6ADC 16-Bit 3.3V 119-Pin BGA 制造商:Rochester Electronics LLC 功能描述:6-CHADC WITH DSP I.C. - Bulk |
| AD7346ASTZ | 制造商:Analog Devices 功能描述: |
| AD7346ASTZ-RL | 功能描述:IC ANALOG FRONT END 制造商:analog devices inc. 系列:* 零件状态:上次购买时间 标准包装:1 |
| AD7346B | 制造商:AD 制造商全称:Analog Devices 功能描述:2 Pair/1 Pair ETSI Compatible HDSL Analog Front End |
| AD734AN | 功能描述:IC MULTIPLIER/DIVIDER 14-DIP RoHS:否 类别:集成电路 (IC) >> 线性 - 模拟乘法器，除法器 系列:- 标准包装:25 系列:HA 功能:模拟乘法器 位元/级数:四象限 封装/外壳:16-CDIP（0.300"，7.62mm） 供应商设备封装:16-CDIP 侧面铜焊 包装:管件 |
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