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参数资料
| 型号： | AD9515/PCBZ |
| 厂商： | Analog Devices Inc |
| 文件页数： | 25/28页 |
| 文件大小： | 0K |
| 描述： | BOARD EVAL CLOCK 2CH AD9515 |
| 设计资源： | Low Jitter Sampling Clock Generator for High Performance ADCs Using AD9958/9858 and AD9515 (CN0109) AD9513/14/15 Eval Brd Schematics AD9513/14/15 Gerber Files AD9515 Eval Brd BOM |
| 标准包装： | 1 |
| 主要目的： | 计时，时钟分配 |
| 已用 IC / 零件： | AD9515 |
| 已供物品： | 板 |
| 相关产品： | AD9515BCPZ-ND - IC CLOCK DIST 2OUT PLL 32LFCSP AD9515BCPZ-REEL7-ND - IC CLOCK DIST 2OUT PLL 32LFCSP |
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AD9515
Data Sheet
Rev. A | Page 6 of 28
Parameter
Min
Typ
Max
Unit
Test Conditions/Comments
CLK = 491.52 MHz, OUT = 245.76 MHz
Divide = 2
@ 10 Hz Offset
125
dBc/Hz
@ 100 Hz Offset
132
dBc/Hz
@ 1 kHz Offset
140
dBc/Hz
@ 10 kHz Offset
151
dBc/Hz
@ 100 kHz Offset
157
dBc/Hz
>1 MHz Offset
158
dBc/Hz
CLK = 245.76 MHz, OUT = 61.44 MHz
Divide = 4
@ 10 Hz Offset
138
dBc/Hz
@ 100 Hz Offset
144
dBc/Hz
@ 1 kHz Offset
154
dBc/Hz
@ 10 kHz Offset
163
dBc/Hz
@ 100 kHz Offset
164
dBc/Hz
>1 MHz Offset
165
dBc/Hz
CLK-TO-LVDS ADDITIVE PHASE NOISE
CLK = 622.08 MHz, OUT= 622.08 MHz
Divide = 1
@ 10 Hz Offset
100
dBc/Hz
@ 100 Hz Offset
110
dBc/Hz
@ 1 kHz Offset
118
dBc/Hz
@ 10 kHz Offset
129
dBc/Hz
@ 100 kHz Offset
135
dBc/Hz
@ 1 MHz Offset
140
dBc/Hz
>10 MHz Offset
148
dBc/Hz
CLK = 622.08 MHz, OUT = 155.52 MHz
Divide = 4
@ 10 Hz Offset
112
dBc/Hz
@ 100 Hz Offset
122
dBc/Hz
@ 1 kHz Offset
132
dBc/Hz
@ 10 kHz Offset
142
dBc/Hz
@ 100 kHz Offset
148
dBc/Hz
@ 1 MHz Offset
152
dBc/Hz
>10 MHz Offset
155
dBc/Hz
CLK = 491.52 MHz, OUT = 245.76 MHz
Divide = 2
@ 10 Hz Offset
108
dBc/Hz
@ 100 Hz Offset
118
dBc/Hz
@ 1 kHz Offset
128
dBc/Hz
@ 10 kHz Offset
138
dBc/Hz
@ 100 kHz Offset
145
dBc/Hz
@ 1 MHz Offset
148
dBc/Hz
>10 MHz Offset
154
dBc/Hz
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PDF描述 |
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