参数资料
| 型号： | AD9549ABCPZ |
| 厂商： | Analog Devices Inc |
| 文件页数： | 4/76页 |
| 文件大小： | 0K |
| 描述： | IC CLOCK GEN/SYNCHRONIZR 64LFCSP |
| 产品变化通告： | AD9549A Mask Change 22/Oct/2010 |
| 标准包装： | 1 |
| 类型： | 时钟/频率发生器，同步器 |
| PLL： | 是 |
| 主要目的： | 以太网，SONET/SDH，Stratum |
| 输入： | CMOS，LVDS，LVPECL |
| 输出： | CMOS，HSTL |
| 电路数： | 1 |
| 比率 - 输入:输出： | 2:2 |
| 差分 - 输入:输出： | 是/是 |
| 频率 - 最大： | 750MHz |
| 电源电压： | 1.71 V ~ 3.465 V |
| 工作温度： | -40°C ~ 85°C |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 64-VFQFN 裸露焊盘，CSP |
| 供应商设备封装： | 64-LFCSP-VQ（9x9） |
| 包装： | 托盘 |
| 产品目录页面： | 776 (CN2011-ZH PDF) |
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AD9549
Rev. D | Page 12 of 76
Pin No.
Input/
Output
Pin Type
Mnemonic
Description
60
I
3.3 V CMOS
IO_UPDATE
I/O Update. A logic transition from 0 to 1 on this pin transfers data from the I/O
port registers to the control registers (see the Write section). This pin has an
internal 50 k pull-down resistor.
61
I
3.3 V CMOS
CSB
Chip Select. Active low. When programming a device, this pin must be held
low. In systems where more than one AD9549 is present, this pin enables
individual programming of each AD9549. This pin has an internal 100 k pull-
up resistor.
62
O
3.3 V CMOS
SDO
Serial Data Output. When the device is in 3-wire mode, data is read on this pin.
There is no internal pull-up/pull-down resistor on this pin.
63
I/O
3.3 V CMOS
SDIO
Serial Data Input/Output. When the device is in 3-wire mode, data is written
via this pin. In 2-wire mode, data reads and writes both occur on this pin. There
is no internal pull-up/pull-down resistor on this pin.
64
I
3.3 V CMOS
SCLK
Serial Programming Clock. Data clock for serial programming. This pin has an
internal 50 k pull-down resistor.
Exposed
Die Pad
O
GND
EPAD
Analog Ground. The exposed thermal pad on the bottom of the package pro-
vides the analog ground for the part. This exposed pad must be connected to
ground for proper operation.
相关PDF资料 |
PDF描述 |
|---|---|
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参数描述 |
|---|---|
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| AD9549APCBZ | 制造商:AD 制造商全称:Analog Devices 功能描述:Dual Input Network Clock Generator/Synchronizer |
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