参数资料
| 型号： | AD9553BCPZ |
| 厂商： | Analog Devices Inc |
| 文件页数： | 27/44页 |
| 文件大小： | 0K |
| 描述： | IC INTEGER-N CLCK GEN 32LFCSP |
| 标准包装： | 1 |
| 类型： | 时钟/频率转换器 |
| PLL： | 是 |
| 主要目的： | 以太网，GPON，SONET/SHD，T1/E1 |
| 输入： | CMOS，LVDS，晶体 |
| 输出： | CMOS，LVDS，LVPECL |
| 电路数： | 1 |
| 比率 - 输入:输出： | 1:2 |
| 差分 - 输入:输出： | 是/是 |
| 频率 - 最大： | 810MHz |
| 电源电压： | 3.135 V ~ 3.465 V |
| 工作温度： | -40°C ~ 85°C |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 32-WFQFN 裸露焊盘，CSP |
| 供应商设备封装： | 32-LFCSP（5x5） |
| 包装： | 托盘 |
| 配用： | AD9553/PCBZ-ND - BOARD EVAL FOR AD9553 |
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AD9553
Rev. A | Page 33 of 44
REGISTER MAP
A bit that is labeled ACLR is an active high, autoclearing bit. When set to a Logic 1 state, the control logic automatically returns it to a
Logic 0 state upon completion of the indicated task.
Table 27. Register Map
Addr.
(Hex)
Register
Name
(MSB)
Bit 7
Bit 6
Bit 5
Bit 4
Bit 3
Bit 2
Bit 1
(LSB)
Bit 0
Default
0x00
Serial port
control
0
LSB first
Soft reset
(ACLR)
1
Soft reset
LSB first
0
0x18
0x04
Readback
control
Unused
Readback
control
0x00
0x05
I/O update
Unused
I/O update
(ACLR)
0x00
0x0A
PLL charge
pump and
PFD control
Charge Pump Current Control[7:0]
(3.5 μA granularity, ~900 μA full scale)
0x80
0x0B
Enable SPI
control of
charge
pump
current
Enable SPI
control of
antiback-
lash
period
Charge Pump
Mode[1:0]
Disable
charge
pump
PFD
feedback
input edge
control
PFD
reference
input edge
control
Force VCO
to midpoint
frequency
0x30
0x0C
Unused
Charge Pump Clock DIV[2:0]
0x00
0x0D
Antibacklash Control[1:0]
Unused
PLL lock
detector
power-
down
0x00
0x0E
VCO control
Calibrate
VCO (ACLR)
Enable
ALC
ALC Threshold[2:0]
Enable SPI
control of
VCO
calibration
Boost VCO
supply
Enable SPI
control of
VCO band
setting
0x70
0x0F
VCO Level Control[5:0]
Unused
0x80
0x10
VCO Band Control[6:0]
Unused
0x80
0x11
PLL and
output
frequency
control
Unused
0x00
0x12
Feedback Divider (N)[19:12]
0x80
0x13
Feedback Divider (N)[11:4]
0x00
0x14
Feedback Divider (N)[3:0]
Enable SPI
control of
feedback
divider
Enable SPI
control of
output
dividers
Unused
Reset PLL
(ACLR)
0x00
0x15
P1 Divider[9:2]
0x20
0x16
P1 Divider[1:0]
P2 Divider[9:4]
0x00
0x17
P2 Divider[3:0]
Enable test
port
Test Mux[1:0]
Unused
0x01
0x18
P0 Divider[2:0]
Unused
0x00
0x19
Unused
0x20
0x1A
Input
receiver and
band gap
control
Reference
reset (ACLR)
Band Gap Voltage Adjust[4:0]
(00000 = maximum, 11111 = minimum)
Unused
Enable SPI
control of
band gap
voltage
0x00
0x1B
XTAL
control
Disable SPI
control of
XTAL tuning
capacitance
0
XTAL Tuning Capacitor Control[5:0]
(0.25 pF per bit, inverted binary coding)
0x80
0x1C
Unused
0x00
0x1D
Unused
0x00
0x1E
Unused
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PDF描述 |
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| AD9554-1BCPZ | 功能描述:IC PLL CLOCK GEN 4OUT 72LFCSP 制造商:analog devices inc. 系列:- 包装:托盘 零件状态:有效 PLL:是 主要用途:以太网，SONET/SDH，Stratum 输入:CMOS，LVDS 输出:HCSL，LVDS，LVPECL 电路数:1 比率 - 输入:输出:4：4 差分 - 输入:输出:是/是 频率 - 最大值:942MHz 电压 - 电源:1.4 V ~ 2.625 V 工作温度:-40°C ~ 85°C 安装类型:表面贴装 封装/外壳:56-WFQFN 裸焊盘，CSP 供应商器件封装:56-LFCSP-WQ（8x8） 标准包装:1 |
| AD9554-1BCPZ-REEL7 | 功能描述:IC PLL CLOCK GEN 4OUT 72LFCSP 制造商:analog devices inc. 系列:- 包装:带卷（TR） 零件状态:有效 PLL:是 主要用途:以太网，SONET/SDH，Stratum 输入:CMOS，LVDS 输出:HCSL，LVDS，LVPECL 电路数:1 比率 - 输入:输出:4：4 差分 - 输入:输出:是/是 频率 - 最大值:942MHz 电压 - 电源:1.4 V ~ 2.625 V 工作温度:-40°C ~ 85°C 安装类型:表面贴装 封装/外壳:56-WFQFN 裸焊盘，CSP 供应商器件封装:56-LFCSP-WQ（8x8） 标准包装:750 |
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