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参数资料
| 型号： | ADP2164ACPZ-R7 |
| 厂商： | Analog Devices Inc |
| 文件页数： | 3/20页 |
| 文件大小： | 0K |
| 描述： | IC REG BUCK SYNC ADJ 4A 16LFCSP |
| 标准包装： | 1 |
| 类型： | 降压（降压） |
| 输出类型： | 可调式 |
| 输出数： | 1 |
| 输出电压： | 0.6 V ~ 6.5 V |
| 输入电压： | 2.7 V ~ 6.5 V |
| PWM 型： | 电流模式 |
| 频率 - 开关： | 500kHz ~ 1.4MHz |
| 电流 - 输出： | 4A |
| 同步整流器： | 是 |
| 工作温度： | -40°C ~ 125°C |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 16-WQFN 裸露焊盘，CSP |
| 包装： | 标准包装 |
| 供应商设备封装： | 16-LFCSP-WQ（4x4） |
| 其它名称： | ADP2164ACPZ-R7DKR |
Data Sheet
SPECIFICATIONS
VIN = PVIN = 3.3 V, EN high, SYNC high, T J = ?40°C to +125°C, unless otherwise noted. Typical values are at T J = 25°C.
Table 1.
ADP2164
Parameter
Symbol
Test Conditions/Comments
Min
Typ
Max
Unit
VIN AND PVIN PINS
VIN Voltage Range
PVIN Voltage Range
VIN
PVIN
2.7
2.7
6.5
6.5
V
V
Quiescent Current
Shutdown Current
VIN Undervoltage Lockout Threshold
I VIN
I SHDN
UVLO
No switching
VIN = PVIN = 6.5 V, EN = GND
VIN rising
VIN falling
2.4
895
9
2.6
2.5
1100
12
2.7
μA
μA
V
V
OUTPUT CHARACTERISTICS
Load Regulation
Line Regulation
I O = 0 A to 4 A
I O = 2 A
0.05
0.05
%/A
%/V
FB PIN
FB Regulation Voltage
FB Bias Current
V FB
I FB
T J = ?40°C to +125°C
0.591
0.6
0.01
0.609
0.1
V
μA
SW PIN
High-Side On Resistance 1
Low-Side On Resistance 1
SW Peak Current Limit
VIN = PVIN = 3.3 V, I SW = 500 mA
VIN = PVIN = 5 V, I SW = 500 mA
VIN = PVIN = 3.3 V, I SW = 500 mA
VIN = PVIN = 5 V, I SW = 500 mA
High-side switch, PVIN = 3.3 V
35
30
24
20
5
52
43
32
29
6.2
70
55
40
35
7.4
mΩ
mΩ
mΩ
mΩ
A
SW Maximum Duty Cycle
SW Minimum On Time 2
Full frequency
Full frequency
100
100
%
ns
TRK PIN
TRK Input Voltage Range
0
600
mV
TRK to FB Offset Voltage
TRK Input Bias Current
TRK = 0 mV to 500 mV
?15
+15
100
mV
nA
FREQUENCY
Switching Frequency
f S
RT = VIN
RT = GND
RT = 91 kΩ
1.08
540
480
1.2
600
600
1.32
660
720
MHz
kHz
kHz
Switching Frequency Range
500
1400
kHz
RT Pin Input High Voltage
RT Pin Input Low Voltage
SYNC PIN
1.2
0.45
V
V
Synchronization Range
0.5
1.4
MHz
Minimum Pulse Width
Minimum Off Time
Input High Voltage
Input Low Voltage
PGOOD PIN
100
100
1.2
0.4
ns
ns
V
V
Power-Good Range
FB rising threshold
105
110
115
%
FB rising hysteresis
2.5
%
Power-Good Deglitch Time
FB falling threshold
FB falling hysteresis
From FB to PGOOD
85
90
2.5
16
95
%
%
Clock
cycles
Power-Good Leakage Current
Power-Good Output Low Voltage
V PGOOD = 5 V
I PGOOD = 1 mA
0.1
170
1
220
μA
mV
Rev. A | Page 3 of 20
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