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参数资料
| 型号： | ADS6242IRGZTG4 |
| 厂商： | TEXAS INSTRUMENTS INC |
| 元件分类： | ADC |
| 英文描述： | 2-CH 14-BIT PROPRIETARY METHOD ADC, SERIAL ACCESS, PQCC48 |
| 封装： | 7 X 7 MM, GREEN, PLASTIC, QFN-48 |
| 文件页数： | 44/76页 |
| 文件大小： | 3497K |
| 代理商： | ADS6242IRGZTG4 |
第1页第2页第3页第4页第5页第6页第7页第8页第9页第10页第11页第12页第13页第14页第15页第16页第17页第18页第19页第20页第21页第22页第23页第24页第25页第26页第27页第28页第29页第30页第31页第32页第33页第34页第35页第36页第37页第38页第39页第40页第41页第42页第43页当前第44页第45页第46页第47页第48页第49页第50页第51页第52页第53页第54页第55页第56页第57页第58页第59页第60页第61页第62页第63页第64页第65页第66页第67页第68页第69页第70页第71页第72页第73页第74页第75页第76页
www.ti.com
S0167-05
CLKP
CLKM
DifferentialSine-Wave
orPECL orLVDSClockInput
ADS6xxx
0.1 F
m
0.1 F
m
V
CC
V
CC
REF_IN
VCXO_INM
C
P
_
O
U
T
CTRL
OUTP
OUTM
Y0B
Y0
ADS6xxx
CLKM
CLKP
VCXO
CDCM7005
VCXO_INP
Reference Clock
S0238-02
S0168-07
CLKP
CLKM
CMOSClockInput
ADS6xxx
0.1 F
m
0.1 F
m
SLAS542A – MAY 2007 – REVISED JULY 2007
Figure 91. Differential Clock Driving Circuit
Figure 92 shows a typical scheme using PECL clock drive from a CDCM7005 clock driver. SNR performance
with this scheme is comparable with that of a low jitter sine wave clock source.
Figure 92. PECL Clock Drive Using CDCM7005
Single-ended CMOS clock can be ac-coupled to the CLKP input, with CLKM (pin) connected to ground with a
0.1-
μF capacitor, as shown in Figure 93.
Figure 93. Single-Ended Clock Driving Circuit
Copyright 2007, Texas Instruments Incorporated
49
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PDF描述 |
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参数描述 |
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