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参数资料
| 型号： | ADSP-2101BG-100 |
| 厂商： | Analog Devices Inc |
| 文件页数： | 44/64页 |
| 文件大小： | 0K |
| 描述： | IC DSP CONTROLLER 16BIT 68PGA |
| 标准包装： | 1 |
| 系列： | ADSP-21xx |
| 类型： | 定点 |
| 接口： | 同步串行端口（SSP） |
| 时钟速率： | 25MHz |
| 非易失内存： | 外部 |
| 芯片上RAM： | 6kB |
| 电压 - 输入/输出： | 5.00V |
| 电压 - 核心： | 5.00V |
| 工作温度： | -40°C ~ 85°C |
| 安装类型： | 通孔 |
| 封装/外壳： | 68-BEPGA |
| 供应商设备封装： | 68-PGA（27.89x27.89） |
| 包装： | 托盘 |
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ADSP-21xx
REV. B
–49–
Frequency
10.24 MHz
Dependency
Parameter
Min
Max
Min
Max
Unit
Switching Characteristic:
tDW
Data Setup before WR High
38.8
0.5tCK – 10 + w
ns
tDH
Data Hold after WR High
14.4
0.25tCK – 10
ns
tWP
WR Pulse Width
43.8
0.5tCK – 5 + w
ns
tWDE
WR Low to Data Enabled
0
tASW
A0–A13, DMS, PMS Setup before WR Low
12.4
0.25tCK – 12
ns
tDDR
Data Disable before WR or RD Low
14.4
0.25tCK – 10
ns
tCWR
CLKOUT High to WR Low
19.4
34.4
0.25tCK – 5
0.25tCK + 10
ns
tAW
A0–A13, DMS, PMS, Setup before WR Deasserted
58.2
0.75tCK – 15 + w
ns
tWRA
A0–A13, DMS, PMS Hold After WR Deasserted
14.4
0.25tCK – 10
ns
tWWR
WR High to RD or WR Low
38.8
0.5tCK – 10
ns
w = wait states
× t
CK.
TIMING PARAMETERS (ADSP-2103/2162/2164)
MEMORY WRITE
Figure 43. Memory Write
CLKOUT
A0 – A13
D
t
WR A
WR
DMS, PMS
t
WWR
t
WP
t
AS W
t
AW
t
CWR
RD
t
DH
t
DD R
t
WDE
t
DW
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