参数资料
型号: ADSP-21478BCPZ-1A
厂商: Analog Devices Inc
文件页数: 30/76页
文件大小: 0K
描述: IC DSP SHARK 200MHZ 88LFCSP
标准包装: 1
系列: SHARC®
类型: 浮点
接口: DAI,DPI,EBI/EMI,I²C,SPI,SPORT,UART/USART
时钟速率: 200MHz
非易失内存: ROM(4Mb)
芯片上RAM: 3Mb
电压 - 输入/输出: 3.30V
电压 - 核心: 1.20V
工作温度: -40°C ~ 85°C
安装类型: 表面贴装
封装/外壳: 88-VFQFN 裸露焊盘,CSP
供应商设备封装: 88-LFCSP-VQ(12x12)
包装: 托盘
Rev. C
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July 2013
SDRAM Interface Timing
Table 31. SDRAM Interface Timing
133 MHz
150 MHz
Unit
Parameter
Min
Max
Min
Max
Timing Requirements
tSSDAT
DATA Setup Before SDCLK
0.7
ns
tHSDAT
DATA Hold After SDCLK
1.66
1.5
ns
Switching Characteristics
tSDCLK
1
1 Systems should use the SDRAM model with a speed grade higher than the desired SDRAM controller speed. For example, to run the SDRAM controller at 133 MHz the
SDRAM model with a speed grade of 143 MHz or above should be used. See Engineer-to-Engineer Note “Interfacing SDRAM memory to SHARC processors (EE-286)” for
more information on hardware design guidelines for the SDRAM interface.
SDCLK Period
7.5
6.66
ns
tSDCLKH
SDCLK Width High
2.5
2.2
ns
tSDCLKL
SDCLK Width Low
2.5
2.2
ns
tDCAD
2
2 Command pins include: SDCAS, SDRAS, SDWE, MSx, SDA10, SDQM, SDCKE.
Command, ADDR, Data Delay After SDCLK
5
4.75
ns
tHCAD
Command, ADDR, Data Hold After SDCLK
1
ns
tDSDAT
Data Disable After SDCLK
6.2
5.3
ns
tENSDAT
Data Enable After SDCLK
0.3
ns
Figure 19. SDRAM Interface Timing
SDCLK
DATA (IN)
DATA (OUT)
COMMAND/ADDR
(OUT)
tSDCLKH
tSDCLKL
tHSDAT
tSSDAT
tHCAD
tDCAD
tENSDAT
tDCAD
tDSDAT
tHCAD
tSDCLK
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ADSP-21479KCPZ-1A IC DSP SHARK 200MHZ 88LFCSP
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参数描述
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ADSP-21478KBCZ-1A 功能描述:IC DSP SHARC 200MHZ LP 196CSPBGA RoHS:是 类别:集成电路 (IC) >> 嵌入式 - DSP(数字式信号处理器) 系列:SHARC® 标准包装:2 系列:StarCore 类型:SC140 内核 接口:DSI,以太网,RS-232 时钟速率:400MHz 非易失内存:外部 芯片上RAM:1.436MB 电压 - 输入/输出:3.30V 电压 - 核心:1.20V 工作温度:-40°C ~ 105°C 安装类型:表面贴装 封装/外壳:431-BFBGA,FCBGA 供应商设备封装:431-FCPBGA(20x20) 包装:托盘
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