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参数资料
型号： ADSP-BF527BBCZ-5A
厂商： Analog Devices Inc
文件页数： 31/88页
文件大小： 0K
描述： IC DSP 16BIT 533MHZ 208CSPBGA
产品变化通告： Datasheet Specification Change 14/Dec/2009
标准包装： 1
系列： Blackfin®
类型： 定点
接口： DMA，以太网，I²C，PPI，SPI，SPORT，UART，USB
时钟速率： 533MHz
非易失内存： ROM（32 kB）
芯片上RAM： 132kB
电压 - 输入/输出： 1.8V，2.5V，3.3V
电压 - 核心： 1.15V
工作温度： -40°C ~ 85°C
安装类型： 表面贴装
封装/外壳： 208-LFBGA，CSPBGA
供应商设备封装： 208-CSPBGA
包装： 托盘
配用： EVAL-SDP-CB1Z-ND - BOARD EVALUATION FOR SDP-CB1
ADZS-BF527-MPSKIT-ND - BOARD EVAL MEDIA PLAYER BF527
ADZS-BF527-EZLITE-ND - BOARD EVAL ADSP-BF527
ADSP-BF522/ADSP-BF523/ADSP-BF524/ADSP-BF525/ADSP-BF526/ADSP-BF527
Clock Related Operating Conditions
for ADSP-BF523/ADSP-BF525/ADSP-BF527 Processors
Table 15 describes the core clock timing requirements for the
ADSP-BF523/ADSP-BF525/ADSP-BF527 processors. Take care
Use the nominal voltage setting ( Table 15 ) for internal and
external regulators.
in selecting MSEL, SSEL, and CSEL ratios so as not to exceed the
maximum core clock and system clock (see Table 17 ). Table 16
describes phase-locked loop operating conditions.
Table 15. Core Clock (CCLK) Requirements (All Instruction Rates 1 ) for ADSP-BF523/ADSP-BF525/ADSP-BF527 Processors
Parameter
Nominal Voltage Setting
Max
Unit
f CCLK
f CCLK
f CCLK
f CCLK
Core Clock Frequency (V DDINT =1.14 V minimum)
Core Clock Frequency (V DDINT =1.093 V minimum)
Core Clock Frequency (V DDINT = 1.045 V minimum) 4
Core Clock Frequency (V DDINT = 0.95 V minimum)
1.20 V
1.15 V
1.10 V
1.0 V
600 2
533 3
400
400
MHz
MHz
MHz
MHz
1
2
3
4
See the Ordering Guide on Page 88 .
Applies to 600 MHz models only. See the Ordering Guide on Page 88 .
Applies to 533 MHz and 600 MHz models only. See the Ordering Guide on Page 88 .
Applies only to automotive products. See Automotive Products on Page 87 .
Table 16. Phase-Locked Loop Operating Conditions for ADSP-BF523/ADSP-BF525/ADSP-BF527 Processors
Parameter
Min
Max
Unit
f VCO
Voltage Controlled Oscillator (VCO) Frequency
60
Instruction Rate 1
MHz
(Commercial/Industrial Models)
f VCO
Voltage Controlled Oscillator (VCO) Frequency
70
Instruction Rate 1
MHz
(Automotive Models)
1
See the Ordering Guide on Page 88 .
Table 17. SCLK Conditions for ADSP-BF523/ADSP-BF525/ADSP-BF527 Processors
V DDEXT /V DDMEM
1.8 V Nominal 1
V DDEXT /V DDMEM
2.5 V or 3.3 V Nominal
Parameter
Max
Max
Unit
f SCLK
CLKOUT/SCLK Frequency (V DDINT ≥ 1.14 V)
2
100
133 3
MHz
f SCLK
CLKOUT/SCLK Frequency (V DDINT < 1.14 V) 2
100
100
MHz
1
2
3
If either V DDEXT or V DDMEM are operating at 1.8 V nominal, f SCLK is constrained to 100 MHz.
f SCLK must be less than or equal to f CCLK and is subject to additional restrictions for SDRAM interface operation. See Table 38 on Page 47 .
Rounded number. Actual test specification is SCLK period of 7.5 ns. See Table 38 on Page 47 .
Rev. D |
Page 31 of 88 | July 2013
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PDF描述
V300A28E400BF3 CONVERTER MOD DC/DC 28V 400W
TPSC335M035R0700 CAP TANT 3.3UF 35V 20% 2312
HBM15DRUN CONN EDGECARD 30POS .156 DIP SLD
ADSP-BF538BBCZ-5A IC DSP CTLR 16BIT 316CSPBGA
ABM36DSXN CONN EDGECARD 72POS DIP .156 SLD
相关代理商/技术参数
参数描述
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ADSP-BF527BBCZ-6A 功能描述:IC DSP 16BIT 533MHZ 208CSBGA 制造商:analog devices inc. 系列:Blackfin? 包装:托盘 零件状态:有效 类型:定点 接口:DMA，以太网，I2C，PPI，SPI，SPORT，UART，USB 时钟速率:600MHz 非易失性存储器:ROM（32 kB） 片载 RAM:132kB 电压 - I/O:1.8V，2.5V，3.3V 电压 - 内核:1.15V 工作温度:-40°C ~ 85°C（TA） 安装类型:表面贴装 封装/外壳:208-FBGA，CSPBGA 供应商器件封装:208-CSPBGA（17x17） 标准包装:1
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ADSP-BF527KBCZ-5AX 制造商:Analog Devices 功能描述:LOW POWER BLACKFIN PROCESSOR WITH ADVANCED PERIPHERALS - Trays
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