参数资料
型号: ADSP-BF561SKBCZ-5A
厂商: Analog Devices Inc
文件页数: 46/64页
文件大小: 0K
描述: IC DSP CTLR 32BIT BKFN 256CSPBGA
产品培训模块: Blackfin® Processor Core Architecture Overview
Blackfin® Device Drivers
Blackfin® Optimizations for Performance and Power Consumption
Blackfin® System Services
标准包装: 1
系列: Blackfin®
类型: 定点
接口: SPI,SSP,UART
时钟速率: 533MHz
非易失内存: 外部
芯片上RAM: 328kB
电压 - 输入/输出: 2.50V,3.30V
电压 - 核心: 1.25V
工作温度: 0°C ~ 70°C
安装类型: 表面贴装
封装/外壳: 256-BGA,CSPBGA
供应商设备封装: 256-CSPBGA(17x17)
包装: 托盘
配用: ADZS-BFAUDIO-EZEXT-ND - BOARD EVAL AUDIO BLACKFIN
ADZS-BF561-EZLITE-ND - BOARD EVAL ADSP-BF561
ADZS-BF561-MMSKIT-ND - KIT STARTER MULTIMEDIA BF561
ADZS-BFAV-EZEXT-ND - BOARD DAUGHT ADSP-BF533,37,61KIT
ADSP-BF561 
256-BALL CSP_BGA (17 mm) BALL ASSIGNMENT
Table 35 lists the 256-Ball CSP_BGA (17 mm × 17 mm) ball
assignment by ball number. Table 36 on Page 48 lists the ball
assignment alphabetically by signal.
Table 35. 256-Ball CSP_BGA (17 mm × 17 mm) Ball Assignment (Numerically by Ball Number)
Ball No.
A1
A2
A3
A4
A5
A6
A7
A8
A9
A10
A11
A12
A13
A14
A15
A16
B1
B2
B3
B4
B5
B6
B7
B8
B9
B10
B11
B12
B13
B14
B15
B16
C1
C2
C3
C4
C5
C6
C7
C8
Signal
VDDEXT
ADDR22
ADDR18
ADDR14
ADDR11
AMS3
AMS0
ARDY
SMS2
SCLK0
SCLK1
ABE2
ABE3
ADDR06
ADDR03
VDDEXT
ADDR24
ADDR23
ADDR19
ADDR17
ADDR12
ADDR10
AMS1
AOE
SMS1
SCKE
BR
BG
ADDR08
ADDR05
ADDR02
DATA04
PPI0SYNC1
ADDR25
PPI0CLK
ADDR20
ADDR16
ADDR13
AMS2
ARE
Ball No.
C9
C10
C11
C12
C13
C14
C15
C16
D1
D2
D3
D4
D5
D6
D7
D8
D9
D10
D11
D12
D13
D14
D15
D16
E1
E2
E3
E4
E5
E6
E7
E8
E9
E10
E11
E12
E13
E14
E15
E16
Signal
SMS3
SWE
SA10
ABE0
ADDR07
ADDR04
DATA0
DATA05
PPI0D15
PPI0SYNC3
PPI0SYNC2
ADDR21
ADDR15
ADDR09
AWE
SMS0
SRAS
SCAS
BGH
ABE1
DATA02
DATA01
DATA03
DATA07
PPI0D11
PPI0D13
PPI0D12
PPI0D14
PPI1CLK
VDDINT
GND
VDDINT
GND
VDDINT
GND
VDDINT
DATA06
DATA13
DATA09
DATA12
Ball No.
F1
F2
F3
F4
F5
F6
F7
F8
F9
F10
F11
F12
F13
F14
F15
F16
G1
G2
G3
G4
G5
G6
G7
G8
G9
G10
G11
G12
G13
G14
G15
G16
H1
H2
H3
H4
H5
H6
H7
H8
Signal
CLKIN
PPI0D10
RESET
BYPASS
VDDEXT
VDDEXT
VDDEXT
GND
GND
VDDEXT
VDDEXT
VDDEXT
DATA11
DATA08
DATA10
DATA16
XTAL
VDDEXT
VDDEXT
GND
GND
VDDEXT
GND
GND
GND
GND
VDDEXT
VDDEXT
DATA17
DATA14
DATA15
DATA18
VROUT0
GND
GND
VDDINT
VDDINT
GND
GND
GND
Ball No.
H9
H10
H11
H12
H13
H14
H15
H16
J1
J2
J3
J4
J5
J6
J7
J8
J9
J10
J11
J12
J13
J14
J15
J16
K1
K2
K3
K4
K5
K6
K7
K8
K9
K10
K11
K12
K13
K14
K15
K16
Signal
GND
GND
GND
GND
GND
DATA21
DATA19
DATA23
VROUT1
PPI0D8
PPI0D7
PPI0D9
GND
GND
GND
GND
GND
GND
GND
VDDINT
VDDINT
DATA20
DATA22
DATA24
PPI0D6
PPI0D5
PPI0D4
PPI1SYNC3
VDDEXT
VDDEXT
GND
GND
GND
GND
VDDEXT
GND
GND
DATA26
DATA25
DATA27
Ball No.
L1
L2
L3
L4
L5
L6
L7
L8
L9
L10
L11
L12
L13
L14
L15
L16
M1
M2
M3
M4
M5
M6
M7
M8
M9
M10
M11
M12
M13
M14
M15
M16
N1
N2
N3
N4
N5
N6
N7
N8
Signal
PPI0D3
PPI0D2
PPI0D1
PPI0D0
VDDEXT
VDDEXT
VDDEXT
VDDEXT
GND
VDDEXT
VDDEXT
VDDEXT
NC
DT0PRI
DATA31
DATA28
PPI1SYNC2
PPI1D15
PPI1D14
PPI1D9
VDDINT
VDDINT
GND
VDDINT
GND
VDDINT
GND
VDDINT
RSCLK0
DR0PRI
TSCLK0
DATA29
PPI1SYNC1
PPI1D10
PPI1D7
PPI1D5
PF0
PF04
PF09
PF12
Rev. E |
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September 2009
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PDF描述
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