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参数资料
| 型号： | AFS250-FPQ208 |
| 元件分类： | FPGA |
| 英文描述： | FPGA, 250000 GATES, PQFP208 |
| 封装： | 0.50 MM PITCH, PQFP-208 |
| 文件页数： | 71/318页 |
| 文件大小： | 10129K |
| 代理商： | AFS250-FPQ208 |
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Device Architecture
2- 146
Pr el iminar y v1 .7
Solution 4
5 V Output Tolerance
Fusion I/Os must be set to 3.3 V LVTTL or 3.3 V LVCMOS mode to reliably drive 5 V TTL receivers. It is
also critical that there be NO external I/O pull-up resistor to 5 V, since this resistor would pull the I/O
pad voltage beyond the 3.6 V absolute maximum value and consequently cause damage to the I/O.
When set to 3.3 V LVTTL or 3.3 V LVCMOS mode, Fusion I/Os can directly drive signals into 5 V TTL
receivers. In fact, VOL =0.4 V and VOH = 2.4 V in both 3.3 V LVTTL and 3.3 V LVCMOS modes exceed
Figure 2-98 Solution 4
Solution 4
2.5 V On-Chip
Clamp
Diode
Requires one board resistor.
Available for LVCMOS 2.5 V / 5.0 V.
On-Chip
Off-Chip
5.5 V
2.5 V
Fusion I/O Input
Rext1
Table 2-74 Comparison Table for 5 V–Compliant Receiver Scheme
Scheme
Board Components
Speed
Current Limitations
1
Two resistors
Low to high1 Limited by transmitter's drive strength
2
Resistor and Zener 3.3 V
Medium
Limited by transmitter's drive strength
3Bus switch
High
N/A
4
Minimum resistor value2
R = 47
Ω at T
J = 70°C
R = 150
Ω at T
J = 85°C
R = 420
Ω at T
J = 100°C
Medium
Maximum diode current at 100% duty cycle, signal
constantly at '1'
52.7 mA at TJ =70°C / 10-year lifetime
16.5 mA at TJ = 85°C / 10-year lifetime
5.9 mA at TJ = 100°C / 10-year lifetime
For duty cycles other than 100%, the currents can be
increased by a factor = 1 / (duty cycle).
Example: 20% duty cycle at 70°C
Maximum current = (1 / 0.2) * 52.7 mA = 5 * 52.7 mA =
263.5 mA
Notes:
1. Speed and current consumption increase as the board resistance values decrease.
2. Resistor values ensure I/O diode long-term reliability.
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PDF描述 |
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| AFS250-FPQG256ES | 制造商:ACTEL 制造商全称:Actel Corporation 功能描述:Actel Fusion Mixed-Signal FPGAs |
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