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参数资料
| 型号： | AGLE600V2-FFG256C |
| 元件分类： | FPGA |
| 英文描述： | FPGA, 13824 CLBS, 600000 GATES, PBGA256 |
| 封装： | 17 X 17 MM, 1.60 MM HEIGHT, 1 MM PITCH, FBGA-256 |
| 文件页数： | 127/156页 |
| 文件大小： | 5023K |
| 代理商： | AGLE600V2-FFG256C |
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IGLOOe DC and Switching Characteristics
2- 58
Advance v0.3
SSTL2 Class II
Stub-Speed Terminated Logic for 2.5 V memory bus standard (JESD8-9). IGLOOe devices support
Class II. This provides a differential amplifier input buffer and a push-pull output buffer.
Timing Characteristics
1.5 V DC Core Voltage
1.2 V DC Core Voltage
Table 2-93 Minimum and Maximum DC Input and Output Levels
SSTL2 Class II
VIL
VIH
VOL
VOH
IOL IOH
IOSH
IOSL
IIL IIH
Drive Strength Min., V Max., V
Min., V
Max., V Max., V
Min., V
mA mA Max., mA1 Max., mA1 A2 A2
18 mA
–0.3
VREF – 0.2 VREF + 0.2
3.6
0.35
VCCI – 0.43 18 18
169
124
10 10
Notes:
1. Currents are measured at 100°C junction temperature and maximum voltage.
2. Currents are measured at 85°C junction temperature.
Figure 2-20 AC Loading
Table 2-94 AC Waveforms, Measuring Points, and Capacitive Loads
Input LOW (V)
Input HIGH (V)
Measuring
Point* (V)
VREF (typ.) (V)
VTT (typ.) (V)
CLOAD (pF)
VREF – 0.2
VREF + 0.2
1.251.251.25
30
Test Point
30 pF
25
SSTL2
Class II
VTT
Table 2-95 SSTL 2 Class II – Applies to 1.5 V DC Core Voltage
Commercial-Case Conditions: TJ = 70°C, Worst-Case VCC = 1.425 V,
Worst-Case VCCI = 2.3 V VREF = 1.25 V
Speed Grade
tDOUT
tDP
tDIN
tPY
tEOUT
tZL
tZH
tLZ
tHZ
tZLS
tZHS
Units
Std.
0.98
1.94
0.19
1.15
0.67
1.97
1.66
5.60
5.29
ns
Note: For specific junction temperature and voltage supply levels, refer to Table 2-6 on page 2-6 for derating
values.
Table 2-96 SSTL 2 Class II – Applies to 1.2 V DC Core Voltage
Commercial-Case Conditions: TJ = 70°C, Worst-Case VCC = 1.14 V,
Worst-Case VCCI = 2.3 V VREF = 1.25 V
Speed Grade
tDOUT
tDP
tDIN
tPY
tEOUT
tZL
tZH
tLZ
tHZ
tZLS
tZHS
Units
Std.
1.55
2.20
0.26
1.39
1.10
2.24
1.97
8.05
7.78
ns
Note: For specific junction temperature and voltage supply levels, refer to Table 2-7 on page 2-6 for derating
values.
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