参数资料
型号: AGLN250V2-ZCSG81
厂商: Microsemi SoC
文件页数: 5/150页
文件大小: 0K
描述: IC FPGA NANO 1KB 250K 81-CSP
标准包装: 640
系列: IGLOO nano
逻辑元件/单元数: 6144
RAM 位总计: 36864
输入/输出数: 60
门数: 250000
电源电压: 1.14 V ~ 1.575 V
安装类型: 表面贴装
工作温度: -20°C ~ 70°C
封装/外壳: 81-WFBGA,CSBGA
供应商设备封装: 81-CSP(5x5)
IGLOO nano DC and Switching Characteristics
2-86
Revision 17
1.2 V DC Core Voltage
Table 2-107 FIFO
Worst Commercial-Case Conditions: TJ = 70°C, VCC = 1.14 V
Parameter
Description
Std.
Units
tENS
REN, WEN Setup Time
3.44
ns
tENH
REN, WEN Hold Time
0.26
ns
tBKS
BLK Setup Time
0.30
ns
tBKH
BLK Hold Time
0.00
ns
tDS
Input Data (DI) Setup Time
1.30
ns
tDH
Input Data (DI) Hold Time
0.41
ns
tCKQ1
Clock High to New Data Valid on RD (flow-through)
5.67
ns
tCKQ2
Clock High to New Data Valid on RD (pipelined)
3.02
ns
tRCKEF
RCLK High to Empty Flag Valid
6.02
ns
tWCKFF
WCLK High to Full Flag Valid
5.71
ns
tCKAF
Clock High to Almost Empty/Full Flag Valid
22.17
ns
tRSTFG
RESET LOW to Empty/Full Flag Valid
5.93
ns
tRSTAF
RESET LOW to Almost Empty/Full Flag Valid
21.94
ns
tRSTBQ
RESET LOW to Data Out Low on RD (flow-through)
3.41
ns
RESET LOW to Data Out Low on RD (pipelined)
4.09
3.41
tREMRSTB
RESET Removal
1.02
ns
tRECRSTB
RESET Recovery
5.48
ns
tMPWRSTB
RESET Minimum Pulse Width
1.18
ns
tCYC
Clock Cycle Time
10.90
ns
FMAX
Maximum Frequency for FIFO
92
MHz
Note: For specific junction temperature and voltage supply levels, refer to Table 2-7 on page 2-7 for derating values.
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