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参数资料
| 型号： | AT49SV12804-70TI |
| 厂商： | ATMEL CORP |
| 元件分类： | DRAM |
| 英文描述： | 128-megabit (8M x 16) Burst/Page Mode 1.8-volt Flash Memory |
| 中文描述： | 8M X 16 FLASH 1.8V PROM, 70 ns, PDSO56 |
| 封装： | 14 X 20 MM, PLASTIC, M0-142EC, TSOP1-56 |
| 文件页数： | 28/41页 |
| 文件大小： | 397K |
| 代理商： | AT49SV12804-70TI |
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28
AT49SN/SV12804 [Preliminary]
3314A–FLASH–4/04
AVD Pulsed Asynchronous Read Cycle Waveform
(1)(2)
Notes:
1. After the high-to-low transition on AVD, AVD may remain low as long as the address is stable.
2. CLK may be static high or static low.
Asynchronous Read Cycle Waveform
(1)(2)(3)(4)
Notes:
1. CE may be delayed up to t
ACC
- t
CE
after the address transition without impact on t
ACC
.
2. OE may be delayed up to t
CE
- t
OE
after the falling edge of CE without impact on t
CE
or by t
ACC
- t
OE
after an address change
without impact on t
ACC
.
3. t
DF
is specified from OE or CE, whichever occurs first (CL = 5 pF).
4. AVD and CLK should be tied low.
AC Asynchronous Read Timing Characteristics
Symbol
Parameter
Min
Max
Units
t
ACC1
t
ACC2
t
CE
t
OE
t
AHAV
t
AVLP
t
AVHP
t
AAV
t
DF
t
OH
t
RO
Access, AVD To Data Valid
70
ns
Access, Address to Data Valid
70
ns
Access, CE to Data Valid
70
ns
OE to Data Valid
20
ns
Address Hold from AVD
9
ns
AVD Low Pulse Width
10
ns
AVD High Pulse Width
10
ns
Address Valid to AVD
7
ns
CE, OE High to Data Float
25
ns
Output Hold from OE, CE or Address, Whichever Occurred First
ns
RESET to Output Delay
150
ns
tCE
tACC2
tDF
tDF
tAHAV
DATA VALID
CE
I/O0-I/O15
A2 -A22
tAAV
tAVLP
tACC1
AVD
OE
tOE
tAVHP
RESET
tRO
(1)
tACC2
tAHAV
A0 -A1
tAAV
OUTPUT
VALID
I/O0 - I/O15
HIGH Z
RESET
OE
t
OE
t
CE
ADDRESS VALID
t
DF
t
OH
t
ACC2
t
RO
CE
A0 - A22
t
RC
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PDF描述 |
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| AT49SV163DT-80TU | 功能描述:闪存 Parallel 闪存 1.8V 80NS, GR RoHS:否 制造商:ON Semiconductor 数据总线宽度:1 bit 存储类型:Flash 存储容量:2 MB 结构:256 K x 8 定时类型: 接口类型:SPI 访问时间: 电源电压-最大:3.6 V 电源电压-最小:2.3 V 最大工作电流:15 mA 工作温度:- 40 C to + 85 C 安装风格:SMD/SMT 封装 / 箱体: 封装:Reel |
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