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参数资料
| 型号： | AT89LP828-20JU |
| 厂商： | Atmel |
| 文件页数： | 25/149页 |
| 文件大小： | 0K |
| 描述： | MCU 8051 8K FLASH SPI 32PLCC |
| 产品培训模块： | MCU Product Line Introduction |
| 标准包装： | 32 |
| 系列： | 89LP |
| 核心处理器： | 8051 |
| 芯体尺寸： | 8-位 |
| 速度： | 20MHz |
| 连通性： | SPI，UART/USART |
| 外围设备： | 欠压检测/复位，POR，PWM，WDT |
| 输入/输出数： | 30 |
| 程序存储器容量： | 8KB（8K x 8） |
| 程序存储器类型： | 闪存 |
| EEPROM 大小： | 1K x 8 |
| RAM 容量： | 768 x 8 |
| 电压 - 电源 (Vcc/Vdd)： | 2.4 V ~ 5.5 V |
| 振荡器型： | 内部 |
| 工作温度： | -40°C ~ 85°C |
| 封装/外壳： | 32-LCC（J 形引线） |
| 包装： | 管件 |
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120
3654A–MICRO–8/09
AT89LP428/828
23.4
Status Register
The current state of the memory may be accessed by reading the status register. The status reg-
ister is shown in Table 23-4.
23.5
DATA Polling
The AT89LP428/828 implements DATA polling to indicate the end of a programming cycle.
While the device is busy, any attempted read of the last byte written will return the data byte with
the MSB complemented. Once the programming cycle has completed, the true value will be
accessible. During Erase the data is assumed to be FFH and DATA polling will return 7FH.
When writing multiple bytes in a page, the DATA value will be the last data byte loaded before
programming begins, not the written byte with the highest physical address within the page.
23.6
Flash Security
The AT89LP428/828 provides two Lock Bits for Flash Code Memory security. Lock bits can be
left unprogrammed (FFH) or programmed (00H) to obtain the protection levels listed in Table 23-
5. Lock bits can only be erased (set to FFH) by Chip Erase. Lock bit mode 2 disables program-
ming of all memory spaces, including the User Signature Array and User Configuration Fuses.
User fuses must be programmed before enabling Lock bit mode 2 or 3. Lock bit mode 3 imple-
ments mode 2 and also blocks reads from the code memory; however, reads of the User
Signature Array, Atmel Signature Array, and User Configuration Fuses are still allowed.
Table 23-4.
Status
Register
––
LOAD
SUCCESS
WRTINH
BUSY
Bit
7
65
43
2
1
0
Symbol
Function
LOAD
Load Flag. Cleared low by the load page buffer command and set high by the next
memory write. This flag signals that the page buffer was previously loaded with data by
the load page buffer command.
SUCCESS
Success Flag. Cleared low at the start of a programming cycle and will only be set high if
the programming cycle completes without interruption from the brownout detector (BOD).
WRTINH
Write Inhibit Flag. Cleared low by the BOD whenever programming is inhibited due to VCC
falling below the minimum required programming voltage. If a BOD episode occurs during
programming, the SUCCESS flag will remain low after the cycle is complete. WRTINH low
also forces BUSY low.
BUSY
Busy Flag. Cleared low whenever the memory is busy programming or if write is currently
inhibited.
Table 23-5.
Lock Bit Protection Modes
Program Lock Bits (by address)
Mode
00H
01H
Protection Mode
1
FFH
No program lock features
200H
FFH
Further programming of the Flash is disabled
3
00H
Further programming of the Flash is disabled and verify (read)
is also disabled; OCD is disabled
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参数描述 |
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