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参数资料
| 型号： | ATA8743-PXQW |
| 厂商： | Atmel |
| 文件页数： | 120/238页 |
| 文件大小： | 3971K |
| 描述： | MCU W/TRANSMITTER ASK/FSK 24QFN |
| 产品培训模块： | MCU Product Line Introduction |
| 标准包装： | 6,000 |
| 频率： | 868MHz ~ 928MHz |
| 应用： | 家庭自动化，遥感，RKE |
| 调制或协议： | ASK，FSK |
| 数据传输率 - 最大： | 32 kBit/s |
| 功率 - 输出： | 3.5dBm ~ 8dBm |
| 电流 - 传输： | 9.3mA |
| 数据接口： | PCB，表面贴装 |
| 天线连接器： | PCB，表面贴装 |
| 存储容量： | 4kB 闪存，256B EEPROM，256B SRAM |
| 电源电压： | 1.8 V ~ 3.6 V |
| 工作温度： | -40°C ~ 85°C |
| 封装/外壳： | 24-VQFN 裸露焊盘 |
| 包装： | 带卷 (TR) |
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120
9152BINDCO02/10
ATA8743
The timing diagram for the CTC mode is shown in Figure 21-6 on page 120. The counter value
(TCNT1) increases until a compare match occurs with either OCR1A or ICR1, and then counter
(TCNT1) is cleared.
Figure 21-6. CTC Mode, Timing Diagram
An interrupt can be generated at each time the counter value reaches the TOP value by either
using the OCF1A or ICF1 flag according to the register used to define the TOP value. If the inter-
rupt is enabled, the interrupt handler routine can be used for updating the TOP value. However,
changing the TOP to a value close to BOTTOM when the counter is running with none or a low
prescaler value must be done with care since the CTC mode does not have the double buffering
feature. If the new value written to OCR1A or ICR1 is lower than the current value of TCNT1, the
counter will miss the compare match. The counter will then have to count to its maximum value
(0xFFFF) and wrap around starting at 0x0000 before the compare match can occur. In many
cases this feature is not desirable. An alternative will then be to use the fast PWM mode using
OCR1A for defining TOP (WGM13:0 = 15) since the OCR1A then will be double buffered.
For generating a waveform output in CTC mode, the OC1A output can be set to toggle its logical
level on each compare match by setting the Compare Output mode bits to toggle mode
(COM1A1:0 = 1). The OC1A value will not be visible on the port pin unless the data direction for
the pin is set to output (DDR_OC1A = 1). The waveform generated will have a maximum fre-
quency of
1A
= f
clk_I/O
/2 when OCR1A is set to zero (0x0000). The waveform frequency is defined
by the following equation:
The N variable represents the prescaler factor (1, 8, 64, 256, or 1024).
As for the Normal mode of operation, the TOV1 flag is set in the same timer clock cycle that the
counter counts from MAX to 0x0000.
21.9.3
Fast PWM Mode
The fast Pulse Width Modulation or fast PWM mode (WGM13:0 = 5, 6, 7, 14, or 15) provides a
high frequency PWM waveform generation option. The fast PWM differs from the other PWM
options by its single-slope operation. The counter counts from BOTTOM to TOP then restarts
from BOTTOM. In non-inverting Compare Output mode, the Output Compare (OC1x) is cleared
on the compare match between TCNT1 and OCR1x, and set at BOTTOM. In inverting Compare
Output mode output is set on compare match and cleared at BOTTOM. Due to the single-slope
operation, the operating frequency of the fast PWM mode can be twice as high as the phase cor-
CNTn
CnA
Toggle)
OCnA Interrupt Flag Set
or ICFn Interrupt Flag Set
(Interrupt on TOP)
1
4
eriod
2
3
(COMnA1:0 = 1)
CnA
f
clk_I/O
2 N 1 OCRnA
+
(
)
?nbsp ?/DIV>
-------------------------------------------------------
=
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