参数资料
型号: ATA8743-PXQW
厂商: Atmel
文件页数: 39/238页
文件大小: 3971K
描述: MCU W/TRANSMITTER ASK/FSK 24QFN
产品培训模块: MCU Product Line Introduction
标准包装: 6,000
频率: 868MHz ~ 928MHz
应用: 家庭自动化,遥感,RKE
调制或协议: ASK,FSK
数据传输率 - 最大: 32 kBit/s
功率 - 输出: 3.5dBm ~ 8dBm
电流 - 传输: 9.3mA
数据接口: PCB,表面贴装
天线连接器: PCB,表面贴装
存储容量: 4kB 闪存,256B EEPROM,256B SRAM
电源电压: 1.8 V ~ 3.6 V
工作温度: -40°C ~ 85°C
封装/外壳: 24-VQFN 裸露焊盘
包装: 带卷 (TR)
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9152BINDCO02/10
ATA8743
"  Bit 7  Res: Reserved Bit
This bit is reserved for future use and will always read as 0 in ATtiny24/44/84. For compatibility
with future AVR devices, always write this bit to zero. After reading, mask out this bit.
"  Bit 6  Res: Reserved Bit
This bit is reserved in the ATtiny24/44/84 and will always read as zero.
"  Bits 5, 4  EEPM1 and EEPM0: EEPROM
Mode Bits
The EEPROM Programming mode bits setting defines which programming action that will be
triggered when writing EEPE. It is possible to program data in one atomic operation (erase the
old value and program the new value) or to split the Erase and Write operations in two different
operations. The Programming times for the different modes are shown in Table 13-1. While
EEPE is set, any write to EEPMn will be ignored. During reset, the EEPMn bits will be reset to
0b00 unless the EEPROM is busy programming.
"  Bit 3  EERIE: EEPROM Ready Interrupt Enable
Writing EERIE to one enables the EEPROM Ready Interrupt if the I-bit in SREG is set. Writing
EERIE to zero disables the interrupt. The EEPROM Ready Interrupt generates a constant inter-
rupt when Non-volatile memory is ready for programming.
"  Bit 2  EEMPE: EEPROM Master Program Enable
The EEMPE bit determines whether writing EEPE to one will have effect or not.
When EEMPE is set, setting EEPE within four clock cycles will program the EEPROM at the
selected address. If EEMPE is zero, setting EEPE will have no effect. When EEMPE has been
written to one by software, hardware clears the bit to zero after four clock cycles.
"  Bit 1  EEPE: EEPROM Program Enable
The EEPROM Program Enable Signal EEPE is the programming enable signal to the EEPROM.
When EEPE is written, the EEPROM will be programmed according to the EEPMn bits setting.
The EEMPE bit must be written to one before a logical one is written to EEPE, otherwise no
EEPROM write takes place. When the write access time has elapsed, the EEPE bit is cleared by
hardware. When EEPE has been set, the CPU is halted for two cycles before the next instruction
is executed.
"  Bit 0  EERE: EEPROM Read Enable
The EEPROM Read Enable Signal  EERE  is the read strobe to the EEPROM. When the cor-
rect address is set up in the EEAR Register, the EERE bit must be written to one to trigger the
Table 13-1.    EEPROM Mode Bits
EEPM1
EEPM0
Programming
Time
Operation
0
0
3.4 ms
Erase and Write in one operation (Atomic Operation)
0
1
1.8 ms
Erase Only
1
0
1.8 ms
Write Only
1
1

Reserved for future use
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PDF描述
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