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参数资料
| 型号： | ATA8743-PXQW |
| 厂商： | Atmel |
| 文件页数： | 61/238页 |
| 文件大小： | 3971K |
| 描述： | MCU W/TRANSMITTER ASK/FSK 24QFN |
| 产品培训模块： | MCU Product Line Introduction |
| 标准包装： | 6,000 |
| 频率： | 868MHz ~ 928MHz |
| 应用： | 家庭自动化，遥感，RKE |
| 调制或协议： | ASK，FSK |
| 数据传输率 - 最大： | 32 kBit/s |
| 功率 - 输出： | 3.5dBm ~ 8dBm |
| 电流 - 传输： | 9.3mA |
| 数据接口： | PCB，表面贴装 |
| 天线连接器： | PCB，表面贴装 |
| 存储容量： | 4kB 闪存，256B EEPROM，256B SRAM |
| 电源电压： | 1.8 V ~ 3.6 V |
| 工作温度： | -40°C ~ 85°C |
| 封装/外壳： | 24-VQFN 裸露焊盘 |
| 包装： | 带卷 (TR) |
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9152BINDCO02/10
ATA8743
Figure 16-7. Watchdog Timer
16.3 Timed Sequences for Changing the Configuration of the Watchdog Timer
The sequence for changing configuration differs slightly between the two safety levels. Separate
procedures are described for each level.
16.3.1
Safety Level 1
In this mode, the Watchdog Timer is initially disabled, but can be enabled by writing the WDE bit
to one without any restriction. A timed sequence is needed when disabling an enabled Watch-
dog Timer. To disable an enabled Watchdog Timer, the following procedure must be followed:
1. In the same operation, write a logic one to WDCE and WDE. A logic one must be written
to WDE regardless of the previous value of the WDE bit.
2. Within the next four clock cycles, in the same operation, write the WDE and WDP bits as
desired, but with the WDCE bit cleared.
16.3.2
Safety Level 2
In this mode, the Watchdog Timer is always enabled, and the WDE bit will always read as one. A
timed sequence is needed when changing the Watchdog Time-out period. To change the
Watchdog Time-out, the following procedure must be followed:
1. In the same operation, write a logical one to WDCE and WDE. Even though the WDE
always is set, the WDE must be written to one to start the timed sequence.
2. Within the next four clock cycles, in the same operation, write the WDP bits as desired,
but with the WDCE bit cleared. The value written to the WDE bit is irrelevant.
MCU RESET
WATCHDOG
PRESCALER
128 kHz
OSCILLATOR
WATCHDOG
RESET
WDP0
WDP1
WDP2
WDP3
WDE
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