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参数资料
型号： ATMEGA128RFA1-ZUR
厂商： Atmel
文件页数： 172/386页
文件大小： 0K
描述： IC AVR MCU 2.4GHZ XCEIVER 64QFN
产品培训模块： MCU Product Line Introduction
megaAVR Introduction
Introduction to ZigBee Low Power Wireless Networks
标准包装： 1
系列： ATMEGA
频率： 2.4GHz
数据传输率 - 最大： 2Mbps
调制或协议： 802.15.4 Zigbee
应用： 通用
功率 - 输出： 3.5dBm
灵敏度： -100dBm
电源电压： 1.8 V ~ 3.6 V
电流 - 接收： 12.5mA
电流 - 传输： 14.5mA
数据接口： PCB，表面贴装
存储容量： 128kB 闪存，4kB EEPROM，16kB RAM
天线连接器： PCB，表面贴装
工作温度： -40°C ~ 85°C
封装/外壳： 64-VFQFN 裸露焊盘
包装： 带卷 (TR)
其它名称： ATMEGA128RFA1-ZURDKR
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ATmega128
AVR USART vs. AVR
The USART is fully compatible with the AVR UART regarding:
UART – Compatibility
?
?
?
?
?
Bit locations inside all USART registers
Baud Rate Generation
Transmitter Operation
Transmit Buffer Functionality
Receiver Operation
However, the receive buffering has two improvements that will affect the compatibility in some
special cases:
?
?
A second buffer register has been added. The two buffer registers operate as a circular FIFO
buffer. Therefore the UDR must only be read once for each incoming data! More important is
the fact that the error flags (FE and DOR) and the ninth data bit (RXB8) are buffered with the
data in the receive buffer. Therefore the status bits must always be read before the UDR
Register is read. Otherwise the error status will be lost since the buffer state is lost.
The receiver Shift Register can now act as a third buffer level. This is done by allowing the
received data to remain in the serial Shift Register (see Figure 79 ) if the buffer registers are
full, until a new start bit is detected. The USART is therefore more resistant to Data OverRun
(DOR) error conditions.
The following control bits have changed name, but have same functionality and register location:
?
?
CHR9 is changed to UCSZ2
OR is changed to DOR
Clock Generation
The clock generation logic generates the base clock for the transmitter and receiver. The
USART supports four modes of clock operation: Normal Asynchronous, Double Speed Asyn-
chronous, Master Synchronous, and Slave Synchronous mode. The UMSEL bit in USART
Control and Status Register C (UCSRC) selects between asynchronous and synchronous oper-
ation. Double speed (Asynchronous mode only) is controlled by the U2X found in the UCSRA
Register. W hen using Synchronous mode (UMSEL = 1), the Data Direction Register for the XCK
pin (DDR_XCK) controls whether the clock source is internal (Master mode) or external (Slave
mode). The XCK pin is only active when using Synchronous mode.
Figure 80 shows a block diagram of the clock generation logic.
Figure 80. Clock Generation Logic, Block Diagram
UBRR
fosc
U2X
Prescaling
Down-Counter
UBRR+1
/2
/4
/2
0
1
OSC
Sync
Edge
DDR_XCK
0
1
txclk
XCK
Pin
DDR_XCK
xcki
xcko
Register
Detector
UCPOL
0
1
1
0
UMSEL
rxclk
Signal description:
172
2467X–AVR–06/11
相关PDF资料
PDF描述
ATMEGA64RZAPV-10AU BUNDLE ATMEGA644P/AT86RF230 TQFP
ATP101-TL-H MOSFET P-CH 30V 25A ATPAK
ATP102-TL-H MOSFET P-CH 30V 40A ATPAK
ATP103-TL-H MOSFET P-CH 30V 55A ATPAK
ATP104-TL-H MOSFET P-CH 30V 75A ATPAK
相关代理商/技术参数
参数描述
ATMEGA128RFA1-ZUR SL514 制造商:Atmel Corporation 功能描述:
ATMEGA128RFA1-ZUR00 制造商:Atmel Corporation 功能描述:2.4GHZ 802.15.4 128K SOC REVF 制造商:Atmel Corporation 功能描述:2.4GHZ 802.15.4 128K SOC REVF T&R - Bulk 制造商:Atmel from Components Direct 功能描述:ATMEL ATMEGA128RFA1-ZUR00 MICROCONTROLLERS (MCU) 制造商:Atmel 功能描述:Atmel ATMEGA128RFA1-ZUR00 Microcontrollers (MCU) 制造商:Atmel Corporation 功能描述:MCU AVR 2.4GHZ 128K FLASH 64VQFN 制造商:Atmel Corporation 功能描述:2.4GHZ 802.15.4 128K SOC Revision F 制造商:Atmel 功能描述:2.4GHZ 802.15.4 128K SOC REVF
ATMEGA128RFR2-ZF 功能描述:IC RF TXRX+MCU 802.15.4 64-VFQFN 制造商:microchip technology 系列:- 包装:托盘 零件状态:在售 类型:TxRx + MCU 射频系列/标准:802.15.4 协议:Zigbee? 调制:DSSS， O-QPSK 频率:2.4GHz 数据速率（最大值）:2Mbps 功率 - 输出:3.5dBm 灵敏度:-100dBm 存储容量:128kB 闪存，4kB EEPROM，16kB SRAM 串行接口:I2C，JTAG，SPI，USART GPIO:35 电压 - 电源:1.8 V ~ 3.6 V 电流 - 接收:5mA ~ 12.5mA 电流 - 传输:8mA ~ 14.5mA 工作温度:-40°C ~ 125°C 封装/外壳:64-VFQFN 裸露焊盘 标准包装:260
ATMEGA128RFR2-ZFR
ATMEGA128RFR2-ZU 制造商:Atmel Corporation 功能描述:2.4GHZ 802.15.4 128K SOC IND 85C - Bulk
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