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参数资料
| 型号： | ATMEGA128RFA1-ZUR |
| 厂商： | Atmel |
| 文件页数： | 98/386页 |
| 文件大小： | 0K |
| 描述： | IC AVR MCU 2.4GHZ XCEIVER 64QFN |
| 产品培训模块： | MCU Product Line Introduction megaAVR Introduction Introduction to ZigBee Low Power Wireless Networks |
| 标准包装： | 1 |
| 系列： | ATMEGA |
| 频率： | 2.4GHz |
| 数据传输率 - 最大： | 2Mbps |
| 调制或协议： | 802.15.4 Zigbee |
| 应用： | 通用 |
| 功率 - 输出： | 3.5dBm |
| 灵敏度： | -100dBm |
| 电源电压： | 1.8 V ~ 3.6 V |
| 电流 - 接收： | 12.5mA |
| 电流 - 传输： | 14.5mA |
| 数据接口： | PCB，表面贴装 |
| 存储容量： | 128kB 闪存，4kB EEPROM，16kB RAM |
| 天线连接器： | PCB，表面贴装 |
| 工作温度： | -40°C ~ 85°C |
| 封装/外壳： | 64-VFQFN 裸露焊盘 |
| 包装： | 带卷 (TR) |
| 其它名称： | ATMEGA128RFA1-ZURDKR |
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f OCn = -----------------------------------------------
ATmega128
value of TCNT0, the counter will miss the compare match. The counter will then have to count to
its maximum value (0xFF) and wrap around starting at 0x00 before the compare match can
occur.
For generating a waveform output in CTC mode, the OC0 output can be set to toggle its logical
level on each compare match by setting the Compare Output mode bits to Toggle mode
(COM01:0 = 1). The OC0 value will not be visible on the port pin unless the data direction for the
pin is set to output. The waveform generated will have a maximum frequency of f OC0 = f clk_I/O /2
when OCR0 is set to zero (0x00). The waveform frequency is defined by the following equation:
f clk_I/O
2 ? N ? ( 1 + OCRn )
The N variable represents the prescale factor (1, 8, 32, 64, 128, 256, or 1024).
As for the normal mode of operation, the TOV0 flag is set in the same timer clock cycle that the
counter counts from MAX to 0x00.
Fast PWM Mode
The fast Pulse W idth Modulation or fast P W M mode ( W GM01:0 = 3) provides a high frequency
P W M waveform generation option. The fast P W M differs from the other P W M option by its sin-
gle-slope operation. The counter counts from BOTTOM to MAX then restarts from BOTTOM. In
non-inverting Compare Output mode, the output compare (OC0) is cleared on the compare
match between TCNT0 and OCR0, and set at BOTTOM. In inverting Compare Output mode, the
output is set on compare match and cleared at BOTTOM. Due to the single-slope operation, the
operating frequency of the fast P W M mode can be twice as high as the phase correct P W M
mode that uses dual-slope operation. This high frequency makes the fast P W M mode well suited
for power regulation, rectification, and DAC applications. High frequency allows physically small
sized external components (coils, capacitors), and therefore reduces total system cost.
In fast P W M mode, the counter is incremented until the counter value matches the MAX value.
The counter is then cleared at the following timer clock cycle. The timing diagram for the fast
P W M mode is shown in Figure 39 . The TCNT0 value is in the timing diagram shown as a histo-
gram for illustrating the single-slope operation. The diagram includes non-inverted and inverted
P W M outputs. The small horizontal line marks on the TCNT0 slopes represent compare
matches between OCR0 and TCNT0.
98
2467X–AVR–06/11
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