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参数资料
| 型号： | ATXMEGA256A3B-AUR |
| 厂商： | Atmel |
| 文件页数： | 154/287页 |
| 文件大小： | 0K |
| 描述： | IC MCU 8BIT 256KB FLASH 64TQFP |
| 标准包装： | 1,000 |
| 系列： | AVR® XMEGA |
| 核心处理器： | AVR |
| 芯体尺寸： | 8/16-位 |
| 速度： | 32MHz |
| 连通性： | I²C，SPI，UART/USART |
| 外围设备： | 欠压检测/复位，DMA，POR，PWM，WDT |
| 输入/输出数： | 49 |
| 程序存储器容量： | 256KB（128K x 16） |
| 程序存储器类型： | 闪存 |
| EEPROM 大小： | 4K x 8 |
| RAM 容量： | 16K x 8 |
| 电压 - 电源 (Vcc/Vdd)： | 1.6 V ~ 3.6 V |
| 数据转换器： | A/D 16x12b; D/A 2x12b |
| 振荡器型： | 内部 |
| 工作温度： | -40°C ~ 85°C |
| 封装/外壳： | 64-TQFP |
| 包装： | 带卷 (TR) |
| 配用： | ATSTK600-RC14-ND - STK600 SOCKET/ADAPTER 64TQFP |
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2011 Microchip Technology Inc.
DS39932D-page 337
PIC18F46J11 FAMILY
20.2
EUSART Asynchronous Mode
The Asynchronous mode of operation is selected by
clearing the SYNC bit (TXSTAx<4>). In this mode, the
EUSART uses standard Non-Return-to-Zero (NRZ)
format (one Start bit, eight or nine data bits and one Stop
bit). The most common data format is 8 bits. An on-chip
dedicated 8-bit/16-bit BRG can be used to derive
standard baud rate frequencies from the oscillator.
The EUSART transmits and receives the LSb first. The
EUSART’s transmitter and receiver are functionally
independent but use the same data format and baud
rate. The BRG produces a clock, either x16 or x64 of the
bit shift rate, depending on the BRGH and BRG16 bits
(TXSTAx<2> and BAUDCONx<3>). Parity is not
supported by the hardware but can be implemented in
software and stored as the ninth data bit.
When operating in Asynchronous mode, the EUSART
module consists of the following important elements:
Baud Rate Generator
Sampling Circuit
Asynchronous Transmitter
Asynchronous Receiver
Auto-Wake-up on Sync Break Character
12-Bit Break Character Transmit
Auto-Baud Rate Detection
20.2.1
EUSART ASYNCHRONOUS
TRANSMITTER
Figure 20-3 displays the EUSART transmitter block
diagram.
The heart of the transmitter is the Transmit (Serial) Shift
Register (TSR). The Shift register obtains its data from
the Read/Write Transmit Buffer register, TXREGx. The
TXREGx register is loaded with data in software. The
TSR register is not loaded until the Stop bit has been
transmitted from the previous load. As soon as the Stop
bit is transmitted, the TSR is loaded with new data from
the TXREGx register (if available).
Once the TXREGx register transfers the data to the TSR
register (occurs in one TCY), the TXREGx register is
empty and the TXxIF flag bit is set. This interrupt can be
enabled or disabled by setting or clearing the interrupt
enable bit, TXxIE. TXxIF will be set regardless of the
state of TXxIE; it cannot be cleared in software. TXxIF is
also not cleared immediately upon loading TXREGx, but
becomes valid in the second instruction cycle following
the load instruction. Polling TXxIF immediately following
a load of TXREGx will return invalid results.
While TXxIF indicates the status of the TXREGx
register; another bit, TRMT (TXSTAx<1>), shows the
status of the TSR register. TRMT is a read-only bit,
which is set when the TSR register is empty. No inter-
rupt logic is tied to this bit so the user has to poll this bit
in order to determine if the TSR register is empty.
To set up an Asynchronous Transmission:
1.
Initialize the SPBRGHx:SPBRGx registers for
the appropriate baud rate. Set or clear the
BRGH and BRG16 bits, as required, to achieve
the desired baud rate.
2.
Enable the asynchronous serial port by clearing
bit, SYNC, and setting bit, SPEN.
3.
If interrupts are desired, set enable bit, TXxIE.
4.
If 9-bit transmission is desired, set transmit bit,
TX9. Can be used as address/data bit.
5.
Enable the transmission by setting bit, TXEN,
which will also set bit, TXxIF.
6.
If 9-bit transmission is selected, the ninth bit
should be loaded in bit, TX9D.
7.
Load data to the TXREGx register (starts
transmission).
8.
If using interrupts, ensure that the GIE and PEIE
bits in the INTCON register (INTCON<7:6>) are
set.
FIGURE 20-3:
EUSART TRANSMIT BLOCK DIAGRAM
Note 1:
The TSR register is not mapped in data
memory, so it is not available to the user.
2:
Flag bit, TXxIF, is set when enable bit,
TXEN, is set.
TXxIF
TXxIE
Interrupt
TXEN
Baud Rate CLK
SPBRGx
Baud Rate Generator
TX9D
MSb
LSb
Data Bus
TXREGx Register
TSR Register
(8)
0
TX9
TRMT
SPEN
TXx pin
Pin Buffer
and Control
8
SPBRGHx
BRG16
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