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参数资料
| 型号： | C8051F410-TB |
| 厂商： | Silicon Laboratories Inc |
| 文件页数： | 177/270页 |
| 文件大小： | 0K |
| 描述： | BOARD PROTOTYPING W/C8051F410 |
| 标准包装： | 1 |
| 类型： | MCU |
| 适用于相关产品： | C8051F410 |
| 所含物品： | 板 |
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C8051F410/1/2/3
258
Rev. 1.1
25.3.1. Watchdog Timer Operation
While the WDT is enabled:
PCA counter is forced on.
Writes to PCA0L and PCA0H are not allowed.
PCA clock source bits (CPS2-CPS0) are frozen.
PCA Idle control bit (CIDL) is frozen.
Module 5 is forced into software timer mode.
Writes to the Module 5 mode register (PCA0CPM5) are disabled.
While the WDT is enabled, writes to the CR bit will not change the PCA counter state; the counter will run
until the WDT is disabled. The PCA counter run control (CR) will read zero if the WDT is enabled but user
software has not enabled the PCA counter. If a match occurs between PCA0CPH5 and PCA0H while the
WDT is enabled, a reset will be generated. To prevent a WDT reset, the WDT may be updated with a write
of any value to PCA0CPH5. Upon a PCA0CPH5 write, PCA0H plus the offset held in PCA0CPL5 is loaded
into PCA0CPH5 (See Figure 25.10).
PCA0H
Enable
PCA0L Overflow
Reset
PCA0CPL5
8-bit Adder
PCA0CPH5
Adder
Enable
PCA0MD
C
I
D
L
W
D
T
E
C
F
C
P
S
1
C
P
S
0
W
D
L
C
K
C
P
S
2
Match
Write to
PCA0CPH5
8-bit
Comparator
Figure 25.10. PCA Module 5 with Watchdog Timer Enabled
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PDF描述 |
|---|---|
| EBC25DRYS | CONN EDGECARD 50POS DIP .100 SLD |
| SDR-80-89 | SCOTCH CODE REFILL # 80-89 |
| ECC19DREH-S13 | CONN EDGECARD 38POS .100 EXTEND |
| SDR-U | SCOTCH CODE REFILL U |
| DM163022 | BOARD DEMO PICDEM-2 PLUS |
相关代理商/技术参数 |
参数描述 |
|---|---|
| C8051F410-TB-K | 功能描述:BOARD PROTOTYPING W/C8051F410 制造商:silicon labs 系列:- 零件状态:在售 板类型:评估平台 类型:MCU 8-位 核心处理器:8051 操作系统:- 平台:- 配套使用产品/相关产品:C8051F41x 安装类型:固定 内容:板 标准包装:1 |
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| C8051F411-GMR | 功能描述:8位微控制器 -MCU 50 MIPS 32KB 12ADC RTCLOCK 28 PIN MCU RoHS:否 制造商:Silicon Labs 核心:8051 处理器系列:C8051F39x 数据总线宽度:8 bit 最大时钟频率:50 MHz 程序存储器大小:16 KB 数据 RAM 大小:1 KB 片上 ADC:Yes 工作电源电压:1.8 V to 3.6 V 工作温度范围:- 40 C to + 105 C 封装 / 箱体:QFN-20 安装风格:SMD/SMT |
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