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参数资料
型号： DK-DEV-5SGXEA7N
厂商： Altera
文件页数： 350/527页
文件大小： 0K
描述： KIT DEV STRATIX V FPGA 5SGXEA7
标准包装： 1
系列： Stratix® V
类型： FPGA
适用于相关产品： Stratix? V 5SGXEA7
所含物品： 板
其它名称： 544-2725
DK-DEV-5SGXEA7/ES
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1-50
Transmitter Gearbox
SV52002
2014.01.07
Note: You can enable either the PRBS generator or the PRP generator, but you cannot enable both at the
same time.
Related Information
For PRBS generator implementation information, refer to the Altera Transceiver PHY IP Core User
Guide
Transmitter Gearbox
The transmitter gearbox adapts the PCS data width to a smaller bus width for interfacing with the PMA.
Because of the transmitter gearbox, the difference in the bus widths between the PCS and the PMA is
transparent to the logic in the FPGA fabric.
Figure 1-39: Transmitter Gearbox
66-Bit in 10GBASE-R
67-Bit in Interlaken
TX gearbox
40-Bit Data to Transceiver Channel PMA
data_valid
TX
Bit
Reversal
In addition to providing bus width adaptation, the transmitter gearbox provides the transmitter polarity
inversion, bit reversal, and bit-slip features.
Transmitter Polarity Inversion
Transmitter polarity can be used to reverse the positive and negative differential buffer signals. This is useful
if these signals are reversed on the board or backplane layout.
A high value on the tx_invpolarity register, which is accessed via the Avalon-MM PHY management
interface, inverts the polarity of every bit of the input data word to the serializer in the transmitter datapath.
Because inverting the polarity of each bit has the same effect as swapping the positive and negative signals
of the differential link, correct data is sent to the receiver. Dynamically changing the tx_invpolarity register
value might cause initial disparity errors at the receiver of an 8B/10B encoded link. The downstream system
must be able to tolerate these disparity errors.
If polarity inversion is asserted midway through a serializer word, the word will be corrupted.
Transmitter Bit Reversal
The transmitter gearbox can reverse the order of transmitted bits. By default, the transmitter sends out the
LSB of a word first. Some protocols, such as Interlaken, require that the MSB of a word (bit 66 in a word
[ 66:0 ]) is transmitted first. When you enable the transmitter bit reversal, the parallel input to the gearbox
is swapped and the MSB is sent out first. The Quartus II software automatically sets the bit reversal for
Interlaken configurations.
Altera Corporation
Transceiver Architecture in Stratix V Devices
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