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参数资料
| 型号： | DS26504LN+ |
| 厂商： | Maxim Integrated Products |
| 文件页数： | 38/129页 |
| 文件大小： | 0K |
| 描述： | IC T1/E1/J1 64KCC ELEMENT 64LQFP |
| 产品培训模块： | Lead (SnPb) Finish for COTS Obsolescence Mitigation Program |
| 标准包装： | 160 |
| 功能： | BITS 元件 |
| 接口： | 64KCC，E1，T1 |
| 电路数： | 1 |
| 电源电压： | 3.14 V ~ 3.47 V |
| 电流 - 电源： | 150mA |
| 工作温度： | -40°C ~ 85°C |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 64-LQFP |
| 供应商设备封装： | 64-LQFP（10x10） |
| 包装： | 托盘 |
| 包括： | * |
第1页第2页第3页第4页第5页第6页第7页第8页第9页第10页第11页第12页第13页第14页第15页第16页第17页第18页第19页第20页第21页第22页第23页第24页第25页第26页第27页第28页第29页第30页第31页第32页第33页第34页第35页第36页第37页当前第38页第39页第40页第41页第42页第43页第44页第45页第46页第47页第48页第49页第50页第51页第52页第53页第54页第55页第56页第57页第58页第59页第60页第61页第62页第63页第64页第65页第66页第67页第68页第69页第70页第71页第72页第73页第74页第75页第76页第77页第78页第79页第80页第81页第82页第83页第84页第85页第86页第87页第88页第89页第90页第91页第92页第93页第94页第95页第96页第97页第98页第99页第100页第101页第102页第103页第104页第105页第106页第107页第108页第109页第110页第111页第112页第113页第114页第115页第116页第117页第118页第119页第120页第121页第122页第123页第124页第125页第126页第127页第128页第129页
DS26504 T1/E1/J1/64KCC BITS Element
16 of 129
NAME
TYPE
FUNCTION
RAIS
O
Receive Alarm Indication Signal
T1 Mode: Toggles high when the receive Blue Alarm is detected.
E1 Mode: Toggles high when the receive AIS is detected.
64KCC Mode: This pin is in a high-impedance state.
6312kHz Mode: This pin is in a high-impedance state.
4.4 Controller Interface
NAME
TYPE
FUNCTION
INT/
JACKS0
I/O
Active-Low Interrupt/Jitter Attenuator Clock Select 0
INT: Flags host controller during events, alarms, and conditions defined in the
status registers. Active-low open-drain output.
JACKS0: Hardware Mode: Jitter Attenuator Clock Select 0. Set this pin high
for T1 mode operation when either a 2.048MHz, 4.096MHz, 8.192MHz, or
16.382MHz signal is applied at MCLK.
TMODE1
I
Transmit Mode Select 1. In Hardware Mode (BIS[1:0] = 11), this bit is used to
configure the transmit operating mode.
TMODE2
I
Transmit Mode Select 2. In Hardware Mode (BIS[1:0] = 11), this bit is used to
configure the transmit operating mode.
TSTRST
I
Three-State Control and Device Reset. A dual-function pin. A zero-to-one
transition issues a hardware reset to the DS26504 register set. Configuration
register contents are set to the default state. Leaving TSTRST high three-states
all output and I/O pins (including the parallel control port). Set low for normal
operation. Useful for in-board level testing.
BIS[1:0]
I
Bus Interface Mode Select 1, 0. These bits select the processor interface mode
of operation.
BIS[1:0] : 00 = Parallel Port Mode (Multiplexed)
01 = Parallel Port Mode (Nonmultiplexed)
10 = Serial Port Mode
11 = Hardware Mode
AD[7]/
RITD
I/O
Data Bus D[7] or Address/Data Bus AD[7]/Receive Internal Termination
Disable
A[7]: In nonmultiplexed bus operation (BIS[1:0] = 01), it serves as the data bus
D[7].
AD[7]: In multiplexed bus operation (BIS[1:0] = 00), it serves as the
multiplexed address/data bus AD[7].
RITD: In Hardware Mode (BIS[1:0] = 11), internal receive termination is
disabled when RITD = 1.
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