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参数资料
| 型号： | DS3154N+ |
| 厂商： | Maxim Integrated Products |
| 文件页数： | 38/61页 |
| 文件大小： | 0K |
| 描述： | IC LIU DS3/E3/STS-1 QD 144CSBGA |
| 产品培训模块： | Lead (SnPb) Finish for COTS Obsolescence Mitigation Program |
| 标准包装： | 160 |
| 类型： | 线路接口装置（LIU） |
| 驱动器/接收器数： | 4/4 |
| 规程： | IEEE 1149.1 |
| 电源电压： | 3.135 V ~ 3.465 V |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 144-BGA，CSPBGA |
| 供应商设备封装： | 144-TECSBGA（13x13） |
| 包装： | 管件 |
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DS3151/DS3152/DS3153/DS3154 Single/Dual/Triple/Quad DS3/E3/STS-1 LIUs
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Figure 13-4. CPU Bus Timing Diagram (Multiplexed)
ADDRESS
VALID
DATA VALID
A[5:0]
D[7:0]
WR
CS
RD
t2
t3
t4
t5
t10
ALE
t11
t12
t13
t14
NOTE: t14 STARTS ON THE OCCURRENCE OF EITHER THE RISING EDGE OF ALE OR A VALID ADDRESS, WHICHEVER OCCURS LAST.
NOTE: TO AVOID BUS CONTENTION, STOP DRIVING A[5:0] BEFORE
RD GOES LOW.
INTEL READ CYCLE
D[7:0]
RD
CS
WR
t2
t6
t4
t7
t8
t10
ADDRESS
VALID
A[5:0]
ALE
t11
t12
t13
t14
NOTE: t14 STARTS ON THE OCCURRENCE OF EITHER THE RISING EDGE OF ALE OR A VALID ADDRESS, WHICHEVER OCCURS LAST.
INTEL WRITE CYCLE
相关PDF资料 |
PDF描述 |
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相关代理商/技术参数 |
参数描述 |
|---|---|
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