参数资料
| 型号： | DS3170+ |
| 厂商： | Maxim Integrated Products |
| 文件页数： | 130/230页 |
| 文件大小： | 0K |
| 描述： | IC TXRX DS3/E3 100-CSBGA |
| 产品培训模块： | Lead (SnPb) Finish for COTS Obsolescence Mitigation Program |
| 标准包装： | 640 |
| 功能： | 单芯片收发器 |
| 接口： | DS3，E3 |
| 电路数： | 1 |
| 电源电压： | 3.135 V ~ 3.465 V |
| 电流 - 电源： | 120mA |
| 工作温度： | 0°C ~ 70°C |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 100-LBGA，CSBGA |
| 供应商设备封装： | 100-CSBGA（11x11） |
| 包装： | 托盘 |
| 包括： | DS3 调帧器，E3 调帧器，HDLC 控制器，芯片内 BERT |
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DS3170 DS3/E3 Single-Chip Transceiver
215 of 230
16.1 Framer Data Path AC Characteristics
All AC timing characteristics are specified with a 25 pF capacitive load on all output pins, VIH = 2.4V and VIL = 0.8V.
The voltage threshold for all timing measurements is VDD/2. The generic timing definitions shown in in Figure 16-1,
Figure 16-2, Figure 16-3, and Figure 16-4 apply to this interface.
Table 16-1. Framer Interface Timing
(VDD = 3.3V ±5%, Tj = -40°C to +125°C.)
PARAMETER
SYMBOL
CONDITIONS
MIN
TYP
MAX
UNITS
CLK Frequency
f1(1/t1)
(Note 1)
52
MHz
CLK Clock Duty Cycle (t2/t1)
t2/t1
(Note 2)
40
50
60
%
CLK Rise or Fall Times (20% to 80%)
t3
(Note 2)
4
ns
DIN to CLK Setup Time
t5
(Note 3)
4
ns
CLK to DIN Hold Time
t6
(Note 3)
0
ns
CLK to DOUT Delay
t7
(Note 4)
2
10
ns
(Note 5)
2
8
ns
Note 1:
Any mode, TCLKI, RLCLK input clocks.
Note 2:
Any mode, TCLKI, RLCLK input clocks.
Note 3:
RLCLK clock input to RPOS/RDAT, RNEG/RLCV inputs.
Note 4:
TCLKI, RLCLK clock inputs to TPOS/TDAT, TNEG outputs.
Note 5:
TLCLKn, TCLKO, RCLKO clock outputs to TPOS/TDAT, TNEG outputs.
Table 16-2. System Port Interface Timing
(VDD = 3.3V ±5%, Tj = -40°C to +125°C.)
PARAMETER
SYMBOL
CONDITIONS
MIN
TYP
MAX
UNITS
CLK Frequency
f1(1/t1)
(Note 1)
52
MHz
CLK Clock Duty Cycle (t2/t1)
t2/t1
(Note 2)
40
50
60
%
CLK Rise or Fall times (20% to 80%)
t3
(Note 2)
4
ns
DIN to CLK Setup Time
t5
(Note 3)
3
ns
(Note 4)
7
ns
CLK to DIN Hold Time
t6
(Note 3)
1
ns
(Note 4)
1
ns
CLK to DOUT Delay
t7
(Note 5)
2
10
ns
(Note 6)
2
8
ns
Note 1:
Any mode, TCLKI, RLCLK input clocks.
Note 2:
Any mode, TCLKI, RLCLK input clocks.
Note 3:
TCLKI, RLCLK clock inputs to TSOFI, TSER inputs.
Note 4:
TCLKO, RCLKO clock outputs to TSOFI, TSER inputs.
Note 5:
TCLKI, RLCLK clock input to TSOFO/TDEN, RSER, RSOFO/RDEN outputs.
Note 6:
TCLKO, RCLKO clock output to TSOFO/TDEN, RSER, RSOFO/RDEN outputs.
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| DS3170LN | 制造商:MAXIM 制造商全称:Maxim Integrated Products 功能描述:DS3/E3 Single-Chip Transceiver |
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