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参数资料
| 型号： | DSP56311VF150B1 |
| 厂商： | Freescale Semiconductor |
| 文件页数： | 39/96页 |
| 文件大小： | 0K |
| 描述： | IC DSP 24BIT 150MHZ 196-BGA |
| 标准包装： | 630 |
| 系列： | DSP56K/Symphony |
| 类型： | 定点 |
| 接口： | 主机接口，SSI，SCI |
| 时钟速率： | 150MHz |
| 非易失内存： | ROM（576 B） |
| 芯片上RAM： | 384kB |
| 电压 - 输入/输出： | 3.30V |
| 电压 - 核心： | 1.80V |
| 工作温度： | -40°C ~ 100°C |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 196-LBGA |
| 供应商设备封装： | 196-MAPBGA（15x15） |
| 包装： | 托盘 |
第1页第2页第3页第4页第5页第6页第7页第8页第9页第10页第11页第12页第13页第14页第15页第16页第17页第18页第19页第20页第21页第22页第23页第24页第25页第26页第27页第28页第29页第30页第31页第32页第33页第34页第35页第36页第37页第38页当前第39页第40页第41页第42页第43页第44页第45页第46页第47页第48页第49页第50页第51页第52页第53页第54页第55页第56页第57页第58页第59页第60页第61页第62页第63页第64页第65页第66页第67页第68页第69页第70页第71页第72页第73页第74页第75页第76页第77页第78页第79页第80页第81页第82页第83页第84页第85页第86页第87页第88页第89页第90页第91页第92页第93页第94页第95页第96页
DSP56311 Technical Data, Rev. 8
2-24
Freescale Semiconductor
Specifications
2.4.6
Host Interface Timing
Table 2-14.
Host Interface Timings1,2,12
No.
Characteristic10
Expression
150 MHz
Unit
Min
Max
317
Read data strobe assertion width
5
HACK assertion width
TC + 6.5
13.1
—
ns
318
Read data strobe deassertion width5
HACK deassertion width
6.5
—
ns
319
Read data strobe deassertion width5 after “Last Data Register” reads8,11, or
between two consecutive CVR, ICR, or ISR reads3
HACK deassertion width after “Last Data Register” reads
8,11
2.5
× T
C + 4.4
20.8
—
ns
320
Write data strobe assertion width6
8.7
—ns
321
Write data strobe deassertion width8
HACK write deassertion width
after ICR, CVR and “Last Data Register” writes
after IVR writes, or
after TXH:TXM:TXL writes (with HLEND= 0), or
after TXL:TXM:TXH writes (with HLEND = 1)
2.5
× TC + 4.4
20.8
10.9
—
ns
322
HAS assertion width
6.5
—
ns
323
HAS deassertion to data strobe assertion
4
0.0
—
ns
324
Host data input set-up time before write data strobe deassertion6
6.5
—
ns
325
Host data input hold time after write data strobe deassertion6
2.2
—
ns
326
Read data strobe assertion to output data active from high impedance
5
HACK assertion to output data active from high impedance
2.2
—
ns
327
Read data strobe assertion to output data valid5
HACK assertion to output data valid
—16.5
ns
328
Read data strobe deassertion to output data high impedance5
HACK deassertion to output data high impedance
—6.5
ns
329
Output data hold time after read data strobe deassertion
5
Output data hold time after HACK deassertion
2.2
—
ns
330
HCS assertion to read data strobe deassertion5
TC + 6.5
13.1
—
ns
331
HCS assertion to write data strobe deassertion
6
6.5
—
ns
332
HCS assertion to output data valid
—13.0
ns
333
HCS hold time after data strobe deassertion4
0.0
—
ns
334
Address (HAD[0–7]) set-up time before HAS deassertion (HMUX=1)
3.0
—
ns
335
Address (HAD[0–7]) hold time after HAS deassertion (HMUX=1)
2.2
—
ns
336
HA[8–10] (HMUX=1), HA[0–2] (HMUX=0), HR/W set-up time before data strobe
assertion
4
Read
Write
0
3.0
—
ns
337
HA[8–10] (HMUX=1), HA[0–2] (HMUX=0), HR/W hold time after data strobe
deassertion4
2.2
—
ns
338
Delay from read data strobe deassertion to host request assertion for “Last Data
Register” read
5, 7, 8
TC + 3.5
10.1
—
ns
339
Delay from write data strobe deassertion to host request assertion for “Last Data
Register” write6, 7, 8
1.5
× T
C + 3.5
13.4
—
ns
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PDF描述 |
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参数描述 |
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