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参数资料
型号： DSPIC30F4011T-20E/PT
厂商： Microchip Technology
文件页数： 71/238页
文件大小： 0K
描述： IC DSPIC MCU/DSP 48K 44TQFP
产品培训模块： Asynchronous Stimulus
标准包装： 1,200
系列： dsPIC™ 30F
核心处理器： dsPIC
芯体尺寸： 16-位
速度： 20 MIPS
连通性： CAN，I²C，SPI，UART/USART
外围设备： 高级欠压探测/复位，电机控制 PWM，QEI，POR，PWM，WDT
输入/输出数： 30
程序存储器容量： 48KB（16K x 24）
程序存储器类型： 闪存
EEPROM 大小： 1K x 8
RAM 容量： 2K x 8
电压 - 电源 (Vcc/Vdd)： 2.5 V ~ 5.5 V
数据转换器： A/D 9x10b
振荡器型： 内部
工作温度： -40°C ~ 125°C
封装/外壳： 44-TQFP
包装： 带卷 (TR)
其它名称： DSPIC30F4011T20EP
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dsPIC30F4011/4012
DS70135G-page 162
2010 Microchip Technology Inc.
Any interrupt that is individually enabled (using the
corresponding IE bit) and meets the prevailing priority
level can wake-up the processor. The processor
processes the interrupt and branches to the ISR. The
SLEEP status bit in the RCON register is set upon
wake-up.
All Resets wake-up the processor from Sleep mode.
Any Reset, other than POR, sets the SLEEP status bit.
In a POR, the SLEEP bit is cleared.
If Watchdog Timer is enabled, the processor wakes-up
from Sleep mode upon WDT time-out. The SLEEP and
WDTO status bits are both set.
21.5.2
IDLE MODE
In Idle mode, the clock to the CPU is shut down while
peripherals keep running. Unlike Sleep mode, the clock
source remains active.
Several peripherals have a control bit in each module,
that allows them to operate during Idle.
LPRC Fail-Safe Clock Monitor remains active if clock
failure detect is enabled.
The processor wakes up from Idle if at least one of the
following conditions is true:
Any interrupt that is individually enabled (IE bit is
‘1’) and meets the required priority level
Any Reset (POR, BOR, MCLR)
WDT time-out
Upon wake-up from Idle mode, the clock is re-applied
to
the
CPU
and
instruction
execution
begins
immediately, starting with the instruction following the
PWRSAV
instruction.
Any interrupt that is individually enabled (using IE bit)
and meets the prevailing priority level can wake-up the
processor. The processor processes the interrupt and
branches to the ISR. The IDLE status bit in RCON
register is set upon wake-up.
Any Reset, other than POR, sets the IDLE status bit.
On a POR, the IDLE bit is cleared.
If Watchdog Timer is enabled, then the processor
wakes-up from Idle mode upon WDT time-out. The
IDLE and WDTO status bits are both set.
Unlike wake-up from Sleep, there are no time delays
involved in wake-up from Idle.
21.6
Device Configuration Registers
The Configuration bits in each device Configuration
register specify some of the device modes and are
programmed by a device programmer, or by using the
In-Circuit Serial Programming (ICSP) feature of the
device. Each device Configuration register is a 24-bit
register, but only the lower 16 bits of each register are
used to hold configuration data. There are five device
Configuration registers available to the user:
1.
FOSC (0xF80000): Oscillator Configuration
Register
2.
FWDT (0xF80002): Watchdog Timer
Configuration Register
3.
FBORPOR (0xF80004): BOR and POR
Configuration Register
4.
FGS (0xF8000A): General Code Segment
Configuration Register
5.
FICD (0xF8000C): Debug Configuration
Register
The placement of the Configuration bits is automatically
handled when you select the device in your device
programmer. The desired state of the Configuration bits
may be specified in the source code (dependent on the
language tool used), or through the programming
interface. After the device has been programmed, the
application software may read the Configuration bit
values through the table read instructions. For additional
information,
please
refer
to
the
programming
specifications of the device.
Note:
In spite of various delays applied (TPOR,
TLOCK and TPWRT), the crystal oscillator
(and PLL) may not be active at the end of
the time-out (e.g., for low-frequency crys-
tals). In such cases, if FSCM is enabled,
the device detects this condition as a
clock failure and processes the clock fail-
ure trap. The FRC oscillator is enabled,
and the user must re-enable the crystal
oscillator. If FSCM is not enabled, then the
device simply suspends execution of code
until the clock is stable and remains in
Sleep until the oscillator clock has started.
Note:
If the code protection Configuration fuse
bits
(FGS<GCP>
and
FGS<GWRP>)
have been programmed, an erase of the
entire
code-protected
device
is
only
possible at voltages VDD
≥ 4.5V.
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DSPIC30F4011T-30I/ML 功能描述:数字信号处理器和控制器 - DSP, DSC 16 Bit MCU/DSP 44LD 30M 48KB FL RoHS:否 制造商:Microchip Technology 核心:dsPIC 数据总线宽度:16 bit 程序存储器大小:16 KB 数据 RAM 大小:2 KB 最大时钟频率:40 MHz 可编程输入/输出端数量:35 定时器数量:3 设备每秒兆指令数:50 MIPs 工作电源电压:3.3 V 最大工作温度:+ 85 C 封装 / 箱体:TQFP-44 安装风格:SMD/SMT
DSPIC30F4011T-30I/PT 功能描述:数字信号处理器和控制器 - DSP, DSC 16 Bit MCU/DSP 30M 48KB FL RoHS:否 制造商:Microchip Technology 核心:dsPIC 数据总线宽度:16 bit 程序存储器大小:16 KB 数据 RAM 大小:2 KB 最大时钟频率:40 MHz 可编程输入/输出端数量:35 定时器数量:3 设备每秒兆指令数:50 MIPs 工作电源电压:3.3 V 最大工作温度:+ 85 C 封装 / 箱体:TQFP-44 安装风格:SMD/SMT
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