参数资料
| 型号： | EP2AGX190FF35C5N |
| 厂商： | Altera |
| 文件页数： | 40/90页 |
| 文件大小： | 0K |
| 描述： | IC ARRIA II GX 190K 1152FBGA |
| 产品培训模块： | Three Reasons to Use FPGA's in Industrial Designs |
| 标准包装： | 3 |
| 系列： | Arria II GX |
| LAB/CLB数： | 7612 |
| 逻辑元件/单元数： | 181165 |
| RAM 位总计： | 10177536 |
| 输入/输出数： | 612 |
| 电源电压： | 0.87 V ~ 0.93 V |
| 安装类型： | 表面贴装 |
| 工作温度： | 0°C ~ 85°C |
| 封装/外壳： | 1152-BBGA |
| 供应商设备封装： | 1152-FBGA（27x27） |
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Chapter 1: Device Datasheet for Arria II Devices
1–37
Switching Characteristics
December 2013
Altera Corporation
Table 1–40 lists the transceiver jitter specifications for all supported protocols for
Arria II GX devices.
29
N/A
12.5
9.6
7.7
6.3
4.3
30
N/A
11.4
9
7.4
N/A
31
N/A
12.9
10
8.2
N/A
Table 1–39. Transmitter Pre-Emphasis Levels for Arria II GZ Devices (Part 2 of 2)
Pre-
Emphasis
1st
Post-Tap
Setting
VOD Setting
012345
67
Table 1–40. Transceiver Block Jitter Specifications for Arria II GX Devices (Note 1) (Part 1 of 10)
Symbol/
Description
Conditions
I3
C4
C5, I5
C6
Unit
Min
Typ
Max
Min
Typ
Max
Min
Typ
Max
Min
Typ
Max
SONET/SDH Transmit Jitter Generation (2)
Peak-to-peak
jitter at
622.08 Mbps
Pattern =
PRBS15
—
0.1
—
0.1
—
0.1
—
0.1
UI
RMS jitter at
622.08 Mbps
Pattern =
PRBS15
—
0.01
—
0.01
—
0.01
—
0.01
UI
Peak-to-peak
jitter at
2488.32 Mbps
Pattern =
PRBS15
—
0.1
—
0.1
—
0.1
—
0.1
UI
RMS jitter at
2488.32 Mbps
Pattern =
PRBS15
—
0.01
—
0.01
—
0.01
—
0.01
UI
SONET/SDH Receiver Jitter Tolerance (2)
Jitter tolerance at
622.08 Mbps
Jitter frequency =
0.03 KHz
Pattern = PRBS15
> 15
UI
Jitter frequency =
25 KHZ
Pattern = PRBS15
> 1.5
UI
Jitter frequency =
250 KHz
Pattern = PRBS15
> 0.15
UI
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| EP2AGX190FF35I3N | 功能描述:FPGA - 现场可编程门阵列 FPGA - Arria II GX 7612 LABs 612 IOs RoHS:否 制造商:Altera Corporation 系列:Cyclone V E 栅极数量: 逻辑块数量:943 内嵌式块RAM - EBR:1956 kbit 输入/输出端数量:128 最大工作频率:800 MHz 工作电源电压:1.1 V 最大工作温度:+ 70 C 安装风格:SMD/SMT 封装 / 箱体:FBGA-256 |
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