参数资料
| 型号： | EPF10K200SRC240-1X |
| 厂商： | Altera |
| 文件页数： | 36/100页 |
| 文件大小： | 0K |
| 描述： | IC FLEX 10KS FPGA 200K 240-RQFP |
| 产品培训模块： | Three Reasons to Use FPGA's in Industrial Designs |
| 产品变化通告： | Package Change 30/Jun/2010 |
| 标准包装： | 24 |
| 系列： | FLEX-10KE® |
| LAB/CLB数： | 1248 |
| 逻辑元件/单元数： | 9984 |
| RAM 位总计： | 98304 |
| 输入/输出数： | 182 |
| 门数： | 513000 |
| 电源电压： | 2.375 V ~ 2.625 V |
| 安装类型： | 表面贴装 |
| 工作温度： | 0°C ~ 85°C |
| 封装/外壳： | 240-BFQFP 裸露焊盘 |
| 供应商设备封装： | 240-RQFP（32x32） |
| 其它名称： | EPF10K200SRC2401X |
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40
Altera Corporation
FLEX 10KE Embedded Programmable Logic Devices Data Sheet
for -1 and -2 speed-grade devices, respectively.
Table 12. ClockLock & ClockBoost Parameters for -1 Speed-Grade Devices
Symbol
Parameter
Condition
Min
Typ
Max
Unit
t R
Input rise time
5ns
t F
Input fall time
5ns
t INDUTY
Input duty cycle
40
60
%
f CLK1
Input clock frequency (ClockBoost
clock multiplication factor equals 1)
25
180
MHz
fCLK2
Input clock frequency (ClockBoost
clock multiplication factor equals 2)
16
90
MHz
f CLKDEV
Input deviation from user
specification in the MAX+PLUS II
software
25,000
PPM
t INCLKSTB
Input clock stability (measured
between adjacent clocks)
100
ps
t LOCK
Time required for ClockLock or
ClockBoost to acquire lock
10
s
t JITTER
Jitter on ClockLock or ClockBoost-
generated clock
tINCLKSTB < 100
250
ps
tINCLKSTB < 50
200
ps
tOUTDUTY
Duty cycle for ClockLock or
ClockBoost-generated clock
40
50
60
%
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PDF描述 |
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