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参数资料
| 型号： | EVAL-AD5100EBZ |
| 厂商： | Analog Devices Inc |
| 文件页数： | 9/36页 |
| 文件大小： | 0K |
| 描述： | BOARD EVAL FOR AD5100 |
| 标准包装： | 1 |
| 主要目的： | 电源管理，电源监控器/跟踪器/序列发生器 |
| 已用 IC / 零件： | AD5100 |
| 主要属性： | 电压检测器和监控器 |
| 次要属性： | 开漏极输出 |
| 已供物品： | 板 |
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AD5100
PIN CONFIGURATION AND FUNCTION DESCRIPTIONS
V 1MON 1
GND 2
V OTP 3
16
15
14
V 2MON
GND/NC
V 4MON
AD5100
V 3MON 4 AD0
13
TOP VIEW
MR 5 (Not to Scale) 12 SHDN
WDI 6
SCL 7
SDA 8
11
10
9
SHDNWARN
V 4OUT
RESET
NC = NO CONNECT
Figure 3. Pin Configuration
Table 5. AD5100 Pin Function Descriptions
Pin No.
1
2
3
4
5
6
7
8
9
10
11
12
13
14
15
16
Mnemonic
V 1MON
GND
V OTP
V 3MON
MR
WDI
SCL
SDA
RESET
V 4OUT
SHDNWARN
SHDN
AD0
V 4MON
GND/NC
V 2MON
Description
High Voltage Monitoring Input. AD5100 internal supply is derived from V 1MON . There must be a 10 μF electrolytic
capacitor between this pin and GND, placed as close as possible to the V 1MON pin.
Ground.
One-Time Programmable Supply Voltage for EPROM. A 10 μF decoupling capacitor (low ESR) to GND is required.
Low Voltage Monitoring Input.
Manual Reset Input. Active low.
Watchdog Input.
I 2 C Serial Input Register Clock. Open-drain input. If it is driven directly from a logic driver without the pull-up
resistor, ensure that the V IH minimum is 3.3 V.
I 2 C Serial Data Input/Output. Open-drain input/output. If it is driven directly from a logic driver without the pull-
up resistor, ensure that the V IH minimum is 3.3 V.
Reset. Push-pull output with rail voltage of V 3MON .
Open-Drain Output. Triggered by V 4MON .
Shutdown Warning. Active low, open-drain output.
Shutdown Output. Push-pull output with selectable rail voltage of V 1MON or V REG , the AD5100 internal power (30 V
maximum).
I 2 C Slave Address Configuration. If tied high, this pin can only be tied to 3.3 V maximum.
Low Voltage Monitoring Input. Capable of withstanding 30 V.
Ground/No Connect. Can be grounded or left floating but do not connect to any other potentials.
High Voltage Monitoring Input. It is also the internal supply voltage enabling input.
GND
1
16
2
15
3
14
4
AD5100
TOP VIEW
13
5
6
7
8
(Not to Scale) 12
11
10
9
Figure 4. Recommended PCB Layout for Shielded High Voltage Inputs
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PDF描述 |
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