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参数资料
| 型号： | GS4576S09L-25 |
| 厂商： | GSI TECHNOLOGY |
| 元件分类： | DRAM |
| 英文描述： | DDR DRAM, PBGA144 |
| 封装： | UBGA-144 |
| 文件页数： | 13/64页 |
| 文件大小： | 2691K |
| 代理商： | GS4576S09L-25 |
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Preliminary
GS4576S09/18L
Specifications cited are subject to change without notice. For latest documentation see http://www.gsitechnology.com.
Rev: 1.01 4/2011
20/64
2011, GSI Technology
Burst Length
Read and Write data transfers occur in bursts of 2, 4, or 8 beats. Burst Length is programmed by the user via Mode Register Bit 3
(M3) and Bit 4 (M4). The Read Burst Length diagrams illustrate the different burst lengths with respect to a Read Command.
Changes in the burst length affect the width of the address bus.
Note: Changing the burst length configuration may scramble previously written data. A burst length change must be assumed to
invalidate all stored data.
Read Burst Lengths
READ
Q0
Q1
READ
NOP
Q0
Q1
Q2
Q3
READ
NOP
Q0
Q1
Q2
Q3
Q4
Q5
Q6
Q7
RL = 5
Example BL=2
Example BL=4
Example BL=8
CK
Command
QKx
QVLD
Q
CK1
Command1
QKx1
QVLD1
Q1
CK2
Command2
QKx2
QVLD2
Q2
Address Widths at Different Burst Lengths
Burst Length
Configuration
x 9
x 18
2
A0–A21
A0–A20
4
A0–A20
A0–A19
8
A0–A19
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