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参数资料
| 型号： | HW-V5-ML507-UNI-G |
| 厂商： | Xilinx Inc |
| 文件页数： | 31/60页 |
| 文件大小： | 0K |
| 描述： | EVAL PLATFORM V5 FXT |
| 标准包装： | 1 |
| 系列： | Virtex®-5 FXT |
| 类型： | FPGA |
| 适用于相关产品： | ML507 |
| 所含物品： | ML507 平台，DVI 适配器，小型闪存卡和 SATA 转接线 |
| 相关产品： | XC5VFX70T-2FFG665I-ND - IC FPGA VIRTEX-5FX 70K 665-FCBGA XC5VFX70T-2FFG665C-ND - IC FPGA VIRTEX-5FX 70K 665-FCBGA XC5VFX70T-2FFG1136I-ND - IC FPGA VIRTEX-5FX 70K 1136-FBGA XC5VFX70T-2FFG1136C-ND - IC FPGA VIRTEX-5FX 70K 1136-FBGA XC5VFX70T-1FFG665I-ND - IC FPGA VIRTEX-5FX 70K 665-FCBGA 122-1585-ND - IC FPGA VIRTEX-5FX 70K 665-FCBGA XC5VFX70T-1FFG1136I-ND - IC FPGA VIRTEX-5FX 70K 1136-FBGA 122-1584-ND - IC FPGA VIRTEX-5FX 70K 1136-FBGA XC5VFX70T-1FFG1136CES-ND - IC FPGAVIRTEX5FX ES 70K 1136FBGA XC5VFX70T-1FF1136CES-ND - IC FPGAVIRTEX5FX ES 70K 1136FBGA 更多... |
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R
Detailed Description
21. 10/100/1000 Tri-Speed Ethernet PHY
The board contains a Marvell Alaska PHY device (88E1111) operating at
10/100/1000 Mb/s. The board supports MII, GMII, RGMII, and SGMII interface modes
with the FPGA. The PHY is connected to a Halo HFJ11-1G01E RJ-45 connector with built-in
magnetics. The PHY is configured to default at power-on or reset to the settings shown in
Table 1-15:
Board Connections for PHY Configuration Pins
Config Pin
CONFIG0
CONFIG1
CONFIG2
CONFIG3
Connection on
Board
V CC 2.5V
Ground
V CC 2.5V
V CC 2.5V
Bit[2]
Definition and Value
PHYADR[2] = 1
ENA_PAUSE = 0
ANEG[3] = 1
ANEG[0] = 1
Bit[1]
Definition and Value
PHYADR[1] = 1
PHYADR[4] = 0
ANEG[2] = 1
ENA_XC = 1
Bit[0]
Definition and Value
PHYADR[0] = 1
PHYADR[3] = 0
ANEG[1] = 1
DIS_125 = 1
V CC 2.5V or
CONFIG4
LED_DUPLEX or
LED_LINK1000
HWCFG_MODE[2] = 0 or
1 (Set by J23 and J24)
HWCFG_MODE[1] = 1
HWCFG_MODE[0] = 1
(Set by J23 and J24)
CONFIG5
V CC 2.5V or
DIS_FC = 1
DIS_SLEEP = 1
HWCFG_MODE[3] = 1
LED_LINK10
(Set by J22)
CONFIG6
LED_RX
SEL_BDT = 0
INT_POL = 1
75/50 Ω = 0
ML505/ML506/ML507 Evaluation Platform
UG347 (v3.1.2) May 16, 2011
31
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