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参数资料
| 型号： | HW-V5-ML507-UNI-G |
| 厂商： | Xilinx Inc |
| 文件页数： | 36/60页 |
| 文件大小： | 0K |
| 描述： | EVAL PLATFORM V5 FXT |
| 标准包装： | 1 |
| 系列： | Virtex®-5 FXT |
| 类型： | FPGA |
| 适用于相关产品： | ML507 |
| 所含物品： | ML507 平台，DVI 适配器，小型闪存卡和 SATA 转接线 |
| 相关产品： | XC5VFX70T-2FFG665I-ND - IC FPGA VIRTEX-5FX 70K 665-FCBGA XC5VFX70T-2FFG665C-ND - IC FPGA VIRTEX-5FX 70K 665-FCBGA XC5VFX70T-2FFG1136I-ND - IC FPGA VIRTEX-5FX 70K 1136-FBGA XC5VFX70T-2FFG1136C-ND - IC FPGA VIRTEX-5FX 70K 1136-FBGA XC5VFX70T-1FFG665I-ND - IC FPGA VIRTEX-5FX 70K 665-FCBGA 122-1585-ND - IC FPGA VIRTEX-5FX 70K 665-FCBGA XC5VFX70T-1FFG1136I-ND - IC FPGA VIRTEX-5FX 70K 1136-FBGA 122-1584-ND - IC FPGA VIRTEX-5FX 70K 1136-FBGA XC5VFX70T-1FFG1136CES-ND - IC FPGAVIRTEX5FX ES 70K 1136FBGA XC5VFX70T-1FF1136CES-ND - IC FPGAVIRTEX5FX ES 70K 1136FBGA 更多... |
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Chapter 1: ML505/ML506/ML507 Evaluation Platform
Configuration Address [2:0] allows the user to select among multiple configuration
images. For System ACE configuration, up to eight possible configurations can be stored
on a CF card. The Platform Flash PROM and Linear Flash can hold up to four separate
bitstreams that can be chosen by Configuration Address [2:0].
R
Table 1-18:
Configuration Mode DIP Switch Settings
Mode[2:0]
000
001
010
011
100
101
110
111
Mode
Master Serial (Platform Flash PROM, up to four configurations)
SPI (One configuration)
BPI Up (Parallel NOR Flash, up to four configurations)
BPI Down (Parallel NOR Flash, up to four configurations)
Master SelectMAP (Platform Flash PROM, up to four configurations)
JTAG (PC4, System ACE up to eight configurations)
Slave SelectMAP (Platform Flash PROM, up to four configurations)
Slave Serial (Platform Flash PROM, up to four configurations)
32. Encryption Key Battery
An onboard rechargeable lithium battery is connected to the V BATT pin of the FPGA to
hold the encryption key for the FPGA.
33. SPI Flash
The ML50 x board has a 32-Mb SPI Flash (ST Microelectronics M25P32). The SPI Flash can
be used for FPGA configuration or to hold user data. The SPI Flash can be in-system
programmed using a Xilinx download cable with flying leads attached to header J2
SPI Prog
J2
1
INIT
TMS
TDI
TDO
TCK
GND
VCC3V3
UG347_09_021407
Figure 1-6:
J2 SPI Flash Programming Header
36
ML505/ML506/ML507 Evaluation Platform
UG347 (v3.1.2) May 16, 2011
相关PDF资料 |
PDF描述 |
|---|---|
| HW-V5-ML550-UNI-G | EVALUATION PLATFORM VIRTEX-5 |
| HW-V5-ML555-G | BOARD EVAL FOR VIRTEX-5 ML555 |
| HW-V5-ML561-UNI-G | EVALUATION PLATFORM VIRTEX-5 |
| I-JET | JTAG ARM DEBUGGING PROBE |
| IAC24A | INPUT MODULE AC 5MA 24VDC |
相关代理商/技术参数 |
参数描述 |
|---|---|
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