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参数资料
| 型号： | HW-V5-ML507-UNI-G |
| 厂商： | Xilinx Inc |
| 文件页数： | 57/60页 |
| 文件大小： | 0K |
| 描述： | EVAL PLATFORM V5 FXT |
| 标准包装： | 1 |
| 系列： | Virtex®-5 FXT |
| 类型： | FPGA |
| 适用于相关产品： | ML507 |
| 所含物品： | ML507 平台，DVI 适配器，小型闪存卡和 SATA 转接线 |
| 相关产品： | XC5VFX70T-2FFG665I-ND - IC FPGA VIRTEX-5FX 70K 665-FCBGA XC5VFX70T-2FFG665C-ND - IC FPGA VIRTEX-5FX 70K 665-FCBGA XC5VFX70T-2FFG1136I-ND - IC FPGA VIRTEX-5FX 70K 1136-FBGA XC5VFX70T-2FFG1136C-ND - IC FPGA VIRTEX-5FX 70K 1136-FBGA XC5VFX70T-1FFG665I-ND - IC FPGA VIRTEX-5FX 70K 665-FCBGA 122-1585-ND - IC FPGA VIRTEX-5FX 70K 665-FCBGA XC5VFX70T-1FFG1136I-ND - IC FPGA VIRTEX-5FX 70K 1136-FBGA 122-1584-ND - IC FPGA VIRTEX-5FX 70K 1136-FBGA XC5VFX70T-1FFG1136CES-ND - IC FPGAVIRTEX5FX ES 70K 1136FBGA XC5VFX70T-1FF1136CES-ND - IC FPGAVIRTEX5FX ES 70K 1136FBGA 更多... |
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R
Appendix B
Programming the IDT Clock Chip
Overview
The ML50 x evaluation boards feature an Integrated Device Technology (IDT) 3.3V
EEPROM Programmable Clock Generator that is pre-programmed at the factory. In the
event the chip programming is changed, the instructions in this appendix show how to
return the clock chip to its factory default settings using the following equipment:
?
?
Xilinx download cable
JTAG flying wires
Downloading to the ML50 x Board
1.
Connect a Xilinx download cable to the board using flying leads connected to jumper
J3 ( Figure B-1 ).
CLK Prog
J3
1
TMS
TDI
TDO
TCK
GND
3.3V
UG347_apdx_a_02_020807
Figure B-1:
J3 IDT5V9885 JTAG Connector
2.
3.
4.
5.
6.
Click Start ? iMPACT .
Click Boundary Scan.
Right-click Add Xilinx Device…
Note: The ML50X_clock_setup.svf file is available on the ML50 x product page.
Right-click on the device and select Execute XSVF/SVF .
ML505/ML506/ML507 Evaluation Platform
UG347 (v3.1.2) May 16, 2011
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PDF描述 |
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