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参数资料
| 型号： | HW-V5-ML561-UNI-G-J |
| 厂商： | Xilinx Inc |
| 文件页数： | 8/91页 |
| 文件大小： | 0K |
| 描述： | EVALUATION PLATFORM VIRTEX-5 |
| 产品变化通告： | Development Systems Discontinuation 16/Jan/2012 |
| 标准包装： | 1 |
| 系列： | Virtex®-5 LXT |
| 类型： | FPGA |
| 适用于相关产品： | XC5VLX50T-FFG1136 |
| 所含物品： | 评估平台，线缆，CD，小型闪存卡，DDR2 DIMM，- 不包括电源 - |
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Virtex-5 FPGA Data Sheet: DC and Switching Characteristics
DS202 (v5.3) May 5, 2010
Product Specification
16
GTP_DUAL Tile Switching Characteristics
Consult UG196:Virtex-5 FPGA RocketIO GTP Transceiver User Guide for further information.
Table 30: GTP_DUAL Tile Performance
Symbol
Description
Speed Grade
Units
-3
-2
-1
FGTPMAX
Maximum GTP transceiver data rate
3.75
3.2
Gb/s
FGPLLMAX
Maximum PLL frequency
2.0
GHz
FGPLLMIN
Minimum PLL frequency
1.0
GHz
Table 31: Dynamic Reconfiguration Port (DRP) in the GTP_DUAL Tile Switching Characteristics
Symbol
Description
Speed Grade
Units
-3
-2
-1
FGTPDRPCLK
GTP DCLK (DRP clock) maximum frequency
200
175
150
MHz
Table 32: GTP_DUAL Tile Reference Clock Switching Characteristics
Symbol
Description
Conditions
All Speed Grades
Units
Min
Typ
Max
FGCLK
Reference clock frequency range(1)
CLK
60
350
MHz
TRCLK
Reference clock rise time
20% – 80%
200
400
ps
TFCLK
Reference clock fall time
80% – 20%
200
400
ps
TDCREF
Reference clock duty cycle(2)
CLK
40
50
60
%
TGJTT
Reference clock total jitter, peak-peak(3)
CLK
40
ps
TLOCK
Clock recovery frequency acquisition
time
Initial PLL lock
1
ms
TPHASE
Clock recovery phase acquisition time
Lock to data after PLL has
locked to the reference clock
200
s
Notes:
1.
The clock from the GTP_DUAL differential clock pin pair can be used for all serial bit rates. GREFCLK can be used for serial bit rates up to
1Gb/s.
2.
For reference clock rates above 325 MHz, a duty cycle of 45% to 55% must be maintained.
3.
Measured at the package pin. GTP_DUAL jitter characteristics measured using a clock with specification TGJTT.
X-Ref Target - Figure 5
Figure 5: Reference Clock Timing Parameters
ds202_05_100506
80%
20%
TFCLK
TRCLK
相关PDF资料 |
PDF描述 |
|---|---|
| HW-V5-ML550-UNI-G-J | EVALUATION PLATFORM VIRTEX-5 |
| HW-V5-ML525-UNI-G-J | EVAL PLATFORM ROCKET IO VIRTEX-5 |
| STD21W-F | WIRE & CABLE MARKERS |
| XE8000EV120 | BOARD EVAL FOR SX8722I070TRLF |
| AD923011-200EBZ | BOARD EVAL FOR AD9230 200MSPS |
相关代理商/技术参数 |
参数描述 |
|---|---|
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| HW-VL1 | 制造商:IDEC CORPORATION 功能描述:BARRIER |
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