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参数资料
| 型号： | ICS853058AGT |
| 元件分类： | 编、解码器及复用、解复用 |
| 英文描述： | 853058 SERIES, 8 LINE TO 1 LINE MULTIPLEXER, COMPLEMENTARY OUTPUT, PDSO24 |
| 封装： | 4.40 X 7.80 MM, 0.92 MM HEIGHT, MS-153, TSSOP-24 |
| 文件页数： | 1/17页 |
| 文件大小： | 240K |
| 代理商： | ICS853058AGT |
853058AG
www.icst.com/products/hiperclocks.html
REV. A APRIL 24, 2006
1
Integrated
Circuit
Systems, Inc.
ICS853058
8:1, DIFFERENTIAL-TO-
3.3V OR 2.5V LVPECL/ECL CLOCK MULTIPLEXER
GENERAL DESCRIPTION
The ICS853058 is an 8:1 Differential-to-3.3V
or 2.5V LVPECL / ECL Clock Multiplexer which
can operate up to 2.8GHz and is a member of
the HiPerClockS family of High Performance
Clock Solutions from ICS. The ICS853058 has
8 differential selectable clock inputs. The PCLK, nPCLK
input pairs can accept LVPECL, LVDS, CML or SSTL lev-
els. The fully differential architecture and low propagation
delay make it ideal for use in clock distribution circuits. The
select pins have internal pulldown resistors. The SEL2 pin
is the most significant bit and the binary number applied to
the select pins will select the same numbered data input
(i.e., 000 selects PCLK0, nPCLK0).
FEATURES
High speed 8:1 differential multiplexer
One differential 3.3V or 2.5V LVPECL output
Eight selectable differential PCLK, nPCLK inputs
PCLKx, nPCLKx pairs can accept the following
differential input levels: LVPECL, LVDS, CML, SSTL
Maximum output frequency: 2.8GHz
Translates any single ended input signal to
LVPECL levels with resistor bias on nPCLKx input
RMS phase jitter @155.52MHz: 0.212ps (typical)
Part-to-part skew: 325ps (maximum)
Propagation delay: 450ps (maximum)
LVPECL mode operating voltage supply range:
V
CC = 2.375V to 3.465V, VEE = 0V
ECL mode operating voltage supply range:
V
CC = 0V, VEE = -3.465V to -2.375V
-40°C to 85°C ambient operating temperature
Available in both standard and lead-free RoHS compliant
packages
BLOCK DIAGRAM
PIN ASSIGNMENT
HiPerClockS
ICS
ICS853058
24-Lead, 173-MIL TSSOP
4.4mm x 7.8mm x 0.92mm body package
G Package
Top View
PCLK0
nPCLK0
PCLK1
nPCLK1
VCC
SEL0
SEL1
SEL2
PCLK2
nPCLK2
PCLK3
nPCLK3
PCLK7
nPCLK7
PLCK6
nPCLK6
VCC
Q
nQ
VEE
PCLK5
nPCLK5
PCLK4
nPCLK4
PCLK0
nPCLK0
PCLK1
nPCLK1
PCLK2
nPCLK2
PCLK3
nPCLK3
000
(default)
011
001
010
SEL1 SEL0
Q
nQ
PCLK4
nPCLK4
PCLK5
nPCLK5
PCLK6
nPCLK6
PCLK7
nPCLK7
SEL2
100
111
101
110
1
2
3
4
5
6
7
8
9
10
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