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参数资料
| 型号： | ICS853058AGT |
| 元件分类： | 编、解码器及复用、解复用 |
| 英文描述： | 853058 SERIES, 8 LINE TO 1 LINE MULTIPLEXER, COMPLEMENTARY OUTPUT, PDSO24 |
| 封装： | 4.40 X 7.80 MM, 0.92 MM HEIGHT, MS-153, TSSOP-24 |
| 文件页数： | 4/17页 |
| 文件大小： | 240K |
| 代理商： | ICS853058AGT |
853058AG
www.icst.com/products/hiperclocks.html
REV. A APRIL 24, 2006
12
Integrated
Circuit
Systems, Inc.
ICS853058
8:1, DIFFERENTIAL-TO-
3.3V OR 2.5V LVPECL/ECL CLOCK MULTIPLEXER
SCHEMATIC EXAMPLE
An application schematic example of ICS853058 is shown in
Figure 5. The inputs can accept various types of differential
signals. In this example, the inputs are driven by LVPECL
drivers. The ICS853058 output is an LVPECL driver. An ex-
ample of LVPECL terminations is shown in this schematic.
Other termination approaches are available in the LVPECL
Termination Application Note. It is recommended at least one
decoupling capacitor per power pin. The decoupling capaci-
tor should be low ESR and located as close as possible to the
power pin.
FIGURE 5. ICS853058 SCHEMATIC EXAMPLE
R7
50
Set Logic
Input to
'1'
R5
50
3.3V
C2
0.1u
Zo = 50
Set Logic
Input to
'0'
R2
50
RU2
Not Install
RU1
1K
R8
50
To Logic
Input
pins
R6
50
RD2
1K
3.3V
U1
ICS853058
1
2
3
4
5
6
7
8
9
10
11
12
13
14
15
16
17
18
19
20
24
23
22
21
PCLK0
nPCLK0
PCLK1
nPCLK1
VCC
SEL0
SEL1
SEL2
PCLK2
nPCLK2
PCLK3
nPCLK3
nPCLK4
PCLK4
nPCLK5
PCLK5
VEE
nQ
Q
VCC
PCLK7
nPCLK7
PCLK6
nPCLK6
Zo = 50
C1
0.1u
R4
50
R9
50
Zo = 50
Logic Control Input Examples
Zo = 50
LVPECL
+
-
To Logic
Input
pins
LVPECL
RD1
Not Install
3.3V
R3
50
LVPECL
Zo = 50
R1
50
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