参数资料
型号: ICS95V860YHLF-T
厂商: INTEGRATED DEVICE TECHNOLOGY INC
元件分类: 时钟及定时
英文描述: PLL BASED CLOCK DRIVER, 13 TRUE OUTPUT(S), 0 INVERTED OUTPUT(S), PBGA72
封装: LEAD FREE, BGA-72
文件页数: 1/10页
文件大小: 84K
代理商: ICS95V860YHLF-T
Integrated
Circuit
Systems, Inc.
ICS95V860
0675D—01/07/04
PLL
FB_INT
FB_INC
CLK_INC
CLK_INT
PD#
I2C_SCL, I2C_SDA
I2C_A0, I2CA1
Control
Logic
FB_OUTT
FB_OUTC
CLKT0
CLKT1
CLKT2
CLKT3
CLKT4
CLKT5
CLKT6
CLKT7
CLKT8
CLKT9
CLKC0
CLKC1
CLKC2
CLKC3
CLKC4
CLKC5
CLKC6
CLKC7
CLKC8
CLKC9
CLKT10
CLKT11
CLKC10
CLKC11
CLKT12
CLKC12
Block Diagram
2.5V DDR/Zero Delay Fan Out Buffer (100MHz - 225MHz)
Recommended Application:
DDR Memory Modules / Zero Delay Fan Out Buffer
Product Description/Features:
Low skew, low jitter PLL clock driver
1 to 13 differential clock distribution (SSTL_2)
Feedback pins for input to output synchronization
PD# for power management
Spread Spectrum-tolerant inputs
Auto PD when input signal removed
0°C to 85°C operation
Switching Characteristics:
CYCLE - CYCLE jitter (>100MHz):<75ps
OUTPUT - OUTPUT skew: <70ps
DUTY CYCLE: 49% - 51%
S
T
U
P
N
IS
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2
<Z
Z
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Functionality
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PDF描述
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ICSSSTV16857CG SSTV SERIES, POSITIVE EDGE TRIGGERED D FLIP-FLOP, TRUE OUTPUT, PDSO48
ICSSSTV16857CL-T SSTV SERIES, POSITIVE EDGE TRIGGERED D FLIP-FLOP, TRUE OUTPUT, PDSO48
ICSSSTV16857YG-T SSTV SERIES, POSITIVE EDGE TRIGGERED D FLIP-FLOP, TRUE OUTPUT, PDSO48
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