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参数资料
| 型号： | ICS95V860YHLF-T |
| 厂商： | INTEGRATED DEVICE TECHNOLOGY INC |
| 元件分类： | 时钟及定时 |
| 英文描述： | PLL BASED CLOCK DRIVER, 13 TRUE OUTPUT(S), 0 INVERTED OUTPUT(S), PBGA72 |
| 封装： | LEAD FREE, BGA-72 |
| 文件页数： | 8/10页 |
| 文件大小： | 84K |
| 代理商： | ICS95V860YHLF-T |
7
ICS95V860
0675D—01/07/04
GND
ICS95V860
VDD
VDD/2
V(CLKC)
SCOPE
C=12pF
-VDD/2
VDD/2
Z=60
Z=60
Z=50
Z=50
R=10
R=10
R=50
R=60
R=60
R=50
V(TT)
C=12pF
NOTE: V(TT) = GND
tc(n)
tc(n+1)
tjit(cc) =tc(n) ±tc(n+1)
Figure 1. IBIS Model Output Load
Figure 2. Output Load Test Circuit
Y , FB_OUTC
X
Y , FB_OUTT
X
Parameter Measurement Information
ICS95V860
Figure 3. Cycle-to-Cycle Jitter
相关PDF资料 |
PDF描述 |
|---|---|
| ICS95V860YH-T | PLL BASED CLOCK DRIVER, 13 TRUE OUTPUT(S), 0 INVERTED OUTPUT(S), PBGA72 |
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| ICSSSTV16857CL-T | SSTV SERIES, POSITIVE EDGE TRIGGERED D FLIP-FLOP, TRUE OUTPUT, PDSO48 |
| ICSSSTV16857YG-T | SSTV SERIES, POSITIVE EDGE TRIGGERED D FLIP-FLOP, TRUE OUTPUT, PDSO48 |
| ICSSSTV16857YLLF-T | SSTV SERIES, POSITIVE EDGE TRIGGERED D FLIP-FLOP, TRUE OUTPUT, PDSO48 |
相关代理商/技术参数 |
参数描述 |
|---|---|
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