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参数资料
| 型号： | ICSSSTUAF32866CHLFT |
| 厂商： | INTEGRATED DEVICE TECHNOLOGY INC |
| 元件分类： | 通用总线功能 |
| 英文描述： | 25-BIT CONFIGURABLE REGISTERED BUFFER FOR DDR2 |
| 中文描述： | 32866 SERIES, POSITIVE EDGE TRIGGERED D FLIP-FLOP, TRUE OUTPUT, PBGA96 |
| 封装： | LEAD FREE, MO-205CC, LFBGA-96 |
| 文件页数： | 10/31页 |
| 文件大小： | 562K |
| 代理商： | ICSSSTUAF32866CHLFT |
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ICSSSTUAF32866C
25-BIT CONFIGURABLE REGISTERED BUFFER FOR DDR2
COMMERCIAL TEMPERATURE GRADE
25-BIT CONFIGURABLE REGISTERED BUFFER FOR DDR2
10
ICSSSTUAF32866C
7100/9
Logic Diagram (1:2)
Parity Logic Diagram for 1:2 Register - B Configuration (Positive Logic);
C0 = 1, C1 = 1
RESET
CLK
CLK
V
REF
CE
Parity
Check
C1
G2
H1
J1
11
A3, T3
G5
0
1
D
CLK
R
D
CLK
R
1
0
D
CLK
R
D
CLK
R
A2
D2
PPO
QERR
PAR_IN
G1
CLK
R
2-Bit
Counter
D
CLK
R
0
1
C0
G6
CE
LPS1
(Internal Node)
11
LPS0
(Internal Node)
D1 - D6,
D8 - D13
11
11
Q1B - Q6B,
Q8B - Q13B
11
Q1A - Q6A,
Q8A - Q13A
Q
Q
Q
Q
Q
D1 - D6,
D8 - D13
D1 - D6,
D8 - D13
相关PDF资料 |
PDF描述 |
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参数描述 |
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